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参数资料
| 型号： | IP2005ATRPBF |
| 厂商： | International Rectifier |
| 文件页数： | 12/18页 |
| 文件大小： | 0K |
| 描述： | IC REG BUCK SYNC ADJ 40A LGA |
| 标准包装： | 1 |
| 系列： | iPOWIR™ |
| 类型： | 降压（降压） |
| 输出类型： | 可调式 |
| 输出数： | 1 |
| 输出电压： | 0.8 V ~ 5.5 V |
| 输入电压： | 6.5 V ~ 13.2 V |
| 频率 - 开关： | 250kHz ~ 1.5MHz |
| 电流 - 输出： | 40A |
| 同步整流器： | 是 |
| 工作温度： | -40°C ~ 125°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 电源块（LGA） |
| 包装： | 标准包装 |
| 供应商设备封装： | LGA（7.7x7.7） |
| 产品目录页面： | 1380 (CN2011-ZH PDF) |
| 其它名称： | IP2005ATRPBFDKR |
PD-60325
i P2005APbF
Internal Block Diagram
Figure 11 Internal Block Diagram
Pin Description
Pin Number
1, 8
2
3
4
5
6
7
Pin Name
V IN
Vsw
P GND
V DD
PWM
ENABLE
CV CC
Description
Input voltage pin. Connect input capacitors close to this pin.
Voltage Switching Node – pin connection to the output inductor.
Power Ground
Supply voltage to internal circuitry.
TTL level input to MOSFET drivers. When PWM is HIGH, the Control
FET is on and the Sync FET is off. When PWM is LOW, the Sync FET
is on and the Control FET is off.
When set to logic level high, internal circuitry of the device is enabled.
When set to logic level low, the Control and Synchronous FETs are
turned off.
Output of internal regulator. Attached a minimum of 1.0μF capacitance
from this pin to PGND. Recommended to use 16V, X5R, Ceramic type
capacitor.
www.irf.com
2/8/2008
12
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参数描述 |
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