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参数资料
| 型号： | IR1176 |
| 厂商： | International Rectifier |
| 文件页数： | 4/12页 |
| 文件大小： | 0K |
| 描述： | IC DRIVER SYNC 5V 4A 20-DIP |
| 标准包装： | 18 |
| 配置： | 低端 |
| 输入类型： | 非反相 |
| 电流 - 峰： | 4A |
| 配置数： | 2 |
| 输出数： | 2 |
| 电源电压： | 4 V ~ 5.25 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 通孔 |
| 封装/外壳： | 20-DIP（0.300"，7.62mm） |
| 供应商设备封装： | 20-DIP |
| 包装： | 管件 |
IR1176
Lead Definitions and Assignments
Symbol Description
AVDD
Q1
Power - + 5 V DC to MOSFET drivers
Output - gate drive for Q1 power MOSFET
DTOUT1 Output - sets dead time for Q1 output - used with DTIN1
DTIN1
RADV1
VFLTR1
RVCO1
X1
VDD
Input - sets dead time for Q1 - used with DTOUT1
Output - sets lead time (advance) for Q1
Output - PLL loop filter for Q1 output
Output - sets PLL center frequency for Q1 output
Input - transformer input for Q1
Power - +5 Vdc for internal logic
UVSET
Input - sets UVLO+
If this pin is pulled below 1.25VDC externally, then both Q1 and Q2
outputs will be at Vss (disabled)
RBIAS
AVSS
X2
RVCO2
VFLTR2
RADV2
DTIN2
Output - connected to 34.0K +/- 1% resistor - sets operating current
Ground for MOSFET driver supply (VDD)
Input - transformer input for Q2
Output - sets PLL center frequency for Q2 output
Output - PLL loop filter for Q2
Output - sets lead time (advance) for Q2
Input - sets dead time for Q2 - used with DTOUT2
DTOUT2 Output - sets dead time for Q2 - used with DTIN2
VSS
Q2
Ground for logic supply (AVDD)
Output - gate drive for Q2 power MOSFET
1 *VDD
2 Q1
Q2
VSS
20
19
1 *VDD
2 Q1
Q2
VSS
20
19
1 *VDD
2 Q1
Q2
VSS
20
19
3 DTOUT2
4 DTIN2
5 RADV1
6 VFLTRI
7 RVCO1
DTOUT1
DTIN1
RADV2
VFLTR2
RVCO2
18
17
16
15
14
3 DTOUT2
4 DTIN2
5 RADV1
6 VFLTRI
7 RVCO1
DTOUT1
DTIN1
RADV2
VFLTR2
RVCO2
18
17
16
15
14
3 DTOUT2
4 DTIN2
5 RADV1
6 VFLTRI
7 RVCO1
DTOUT1 18
DTIN1 17
RADV2 16
VFLTR2 15
RVCO2 14
8 X1
9 AVDD
X2
AVSS
13
12
8 X1
9 AVDD
X2
AVSS
13
12
8 X1
9 AVDD
X2
AVSS
13
12
10 UVSET
RBIAS
11
10 UVSET
RBIAS
11
10 UVSET
RBIAS 11
4
IR1176S
(SSOP-20)
IR1176SS
SOIC (wide body)
IR1176
PDIP
www.irf.com
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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