参数资料
| 型号： | ISL34341INZ |
| 厂商： | Intersil |
| 文件页数： | 7/11页 |
| 文件大小： | 0K |
| 描述： | IC VIDEO SERDES LONG 64-EPTQFP |
| 产品培训模块： | Solutions for Industrial Control Applications |
| 标准包装： | 800 |
| 功能： | 串行器/解串器 |
| 输入类型： | LVCMOS |
| 输出类型： | LVCMOS |
| 输入数： | 2 |
| 输出数： | 2 |
| 电源电压： | 1.7 V ~ 3.6 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 64-TQFP 裸露焊盘 |
| 供应商设备封装： | 64-TQFP（10x10） |
| 包装： | 托盘 |
5
FN6827.1
October 8, 2010
HS Generated Output Common Mode Voltage
VOCM
2.35
V
HS Common Mode Serializer-Deserializer
Voltage Difference
ΔVCM
20
120
mV
HS Differential Output Impedance
ROUT
80
100
120
Ω
HS Output Latency
tLPD
Part-to-part
4
7
10
PCLK
HS Output Rise and Fall Times
tR/tF
20% to 80%
150
ps
HS Differential Skew
tSKEW
<10
ps
HS Output Random Jitter
tRJ
13.4
psrms
HS Output Deterministic Jitter
tDJ
40
psP-P
HIGH SPEED RECEIVER
HS Differential Input Voltage
VID
150
mVP-P
HS Generated Input Common Mode Voltage
VICM
2.32
V
HS Differential Input Impedance
RIN
80
100
120
Ω
HS Maximum Jitter Tolerance
0.52
UIP-P
I2C
I2C Clock Rate (on SCL)
fI2C
100
400
kHz
I2C Clock Pulse Width (HI or LO)
1.3
s
I2C Clock Low to Data Out Valid
0
1
s
I2C Start/Stop Setup/Hold Time
0.6
s
I2C Data in Setup Time
100
ns
I2C Data in Hold Time
100
ns
I2C Data out Hold Time
100
ms
Electrical Specifications
Unless otherwise indicated, all data is for: VDD_CDR = VDD_CR = 1.8V, VDD_IO = 3.3V,
VDD_TX = VDD_P = VDD_AN = 3.3V, TA = +25°C, Ref_Res = 3.16kΩ, High-speed AC-coupling
capacitor = 27nF. (Continued)
PARAMETER
SYMBOL
CONDITIONS
MIN
TYP
MAX
UNITS
Pin Descriptions
PIN NUMBER
PIN NAME
DESCRIPTION
SERIALIZER
DESERIALIZER
52 to 63,
2 to 13
RGBA[7:0],
RGBB[7:0], RGBC[7:0]
Parallel video data LVCMOS inputs
Parallel video data LVCMOS outputs
22
HSYNC
Horizontal (line) Sync LVCMOS input
Horizontal (line) Sync LVCMOS output
23
VSYNC
Vertical (frame) Sync LVCMOS input
Vertical (frame) Sync LVCMOS output
21
DATAEN
Video Data Enable LVCMOS input
Video Data Enable LVCMOS output
26
PCLK_IN
Pixel clock LVCMOS input
PLL reference clock LVCMOS input
51
PCLK_OUT
Default; not used
Recovered clock LVCMOS output
41, 40
SERIOP, SERION
High speed differential serial I/O
24
HSYNCPOL
CMOS input for HSYNC
1: HSYNC is active low
0: HSYNC is active high
25
VSYNCPOL
CMOS input for VSYNC
1: VSYNC is active low
0: VSYNC is active high
ISL34341
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