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参数资料
| 型号： | ISL5314INZ |
| 厂商： | Intersil |
| 文件页数： | 7/17页 |
| 文件大小： | 0K |
| 描述： | IC SYNTHESIZER DIGITAL 48-MQFP |
| 标准包装： | 250 |
| 分辨率（位）： | 14 b |
| 主 fclk： | 125MHz |
| 调节字宽（位）： | 48 b |
| 电源电压： | 3 V ~ 5.5 V，4.5 V ~ 5.5 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 48-LQFP |
| 供应商设备封装： | 48-TQFP（7x7） |
| 包装： | 托盘 |
15
FN4901.3
January 19, 2010
FIGURE 7. SERIAL PROGRAMMING, SYNC EARLY MODE (REPRESENTS MINIMUM SCLKS REQUIRED. SCLK CAN FREE RUN.)
CONTROL REGISTER 12 IS SET TO 0001 00XX.
FIGURE 8. SERIAL PROGRAMMING, SYNC LATE BURST MODE (REPRESENTS MINIMUM SCLKS REQUIRED; SCLK CAN FREE RUN);
CONTROL REGISTER 12 IS SET TO 0000 00XX.
Timing Diagrams (Continued)
SSYNC
SDATA
CLK (
fCLK)
ANALOG OUT
t
= 12 fCLK RISING EDGES
OLD FREQ IN THE
NEW FREQ LOADED
SERIAL FREQ
REGISTER
SERIAL DATA (8 BITS SHOWN; MAX IS 40)
SCLK
SCLK EDGES = SERIAL BITS + 3
SERIAL REGISTER
IN THE SERIAL REGISTER
DON’T CARE (CAN FREE RUN)
DON’T CARE (ASSUMED CONTINUOUSLY RUNNING)
DON’T CARE
RESET
OLD FREQ
NEW FREQ
DON’T CARE
tSDH
tSDS
tSSH
tSSS
tSCW
tSSW
tSDW
SSYNC
SDATA
CLK (
fCLK)
ANALOG OUT
t
= 12 fCLK RISING EDGES
OLD FREQ IN THE
NEW FREQ LOADED
SERIAL FREQ
REGISTER
SERIAL DATA (8 BITS SHOWN; MAX IS 40)
SCLK
SCLK EDGES = SERIAL BITS + 3
SERIAL REGISTER
IN THE SERIAL REGISTER
DON’T CARE (CAN FREE RUN)
DON’T CARE (ASSUMED CONTINUOUSLY RUNNING)
DON’T CARE
RESET
OLD FREQ
NEW FREQ
DON’T CARE
ISL5314
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PDF描述 |
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