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参数资料
| 型号： | ISL6128IRZA-T |
| 厂商： | Intersil |
| 文件页数： | 12/23页 |
| 文件大小： | 0K |
| 描述： | IC POWER SUPPLY SEQUENCER 24QFN |
| 标准包装： | 6,000 |
| 应用： | 电源序列发生器 |
| 电源电压： | 1.5 V ~ 5.5 V |
| 电流 - 电源： | 200µA |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 24-VFQFN 裸露焊盘 |
| 供应商设备封装： | 24-QFN 裸露焊盘（4x4） |
| 包装： | 带卷 (TR) |
ISL6123, ISL6124, ISL6125, ISL6126, ISL6127, ISL6128, ISL6130
Using the ISL6125EVAL1Z
Platform
The ISL6125EVAL1Z is the ISL6125-specific evaluation board
that allows evaluation of the ISL6125 and the ISL6130 with
their open-drain outputs (contact Intersil sales support with
Typical Performance Waveforms
5VOUT
RESET
your needs). The UVLO levels, sequence and delays are
programmed exactly like the other ISL612X ICs except that the
ISL6125 and ISL6130 have sequenced, open-drain outputs
rather than charge-pump-driven GATE outputs. See Figure 18
for the ISL6125EVAL1Z schematic and photograph and
Table 3 for the component listing.
5VOUT
ENABLE
3.3VOUT
2.5VOUT
1.5VOUT
3.3VOUT
ENABLE
1.5VOUT
2.5VOUT
1V/DIV
40ms/DIV
1V/DIV
20ms/DIV
FIGURE 9. ISL6124 SEQUENCED TURN-ON
FIGURE 10. ISL6124 SEQUENCED TURN-OFF
T delENLO
GATE 2V/DIV
3.3VO 1V/DIV
GATE 2V/DIV
3.3VO 1V/DIV
EN 2V/DIV
DLY_Vth
DLY_ON 1V/DIV
RESET 2V/DIV
EN 2V/DIV
DLY_OFF 1V/DIV
DLY_Vth
10ms/DIV
FIGURE 11. ISL6123 SINGLE CHANNEL TURN-ON
12
4ms/DIV
FIGURE 12. ISL6123 SINGLE CHANNEL TURN-OFF
FN9005.12
September 26, 2012
相关PDF资料 |
PDF描述 |
|---|---|
| ECM22DTKN | CONN EDGECARD 44POS DIP .156 SLD |
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| 0210391027 | CABLE JUMPER 1MM .254M 31POS |
| H3DDH-1036M | IDC CABLE - HKR10H/AE10M/HKR10H |
相关代理商/技术参数 |
参数描述 |
|---|---|
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