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参数资料
| 型号： | ISL6534CV |
| 厂商： | Intersil |
| 文件页数： | 3/5页 |
| 文件大小： | 660K |
| 描述： | IC REG 3OUT BCK/LINEAR 24EPTSSOP |
| 标准包装： | 62 |
| 拓扑： | 降压（降压）同步（2），线性（LDO）（1） |
| 功能： | 任何功能 |
| 输出数： | 3 |
| 频率 - 开关： | 300kHz ~ 1MHz |
| 电压/电流 - 输出 1： | 控制器 |
| 电压/电流 - 输出 2： | 控制器 |
| 电压/电流 - 输出 3： | 控制器 |
| 带 LED 驱动器： | 无 |
| 带监控器： | 无 |
| 带序列发生器： | 是 |
| 电源电压： | 3.3 V ~ 12 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 24-TSSOP（0.173"，4.40mm）裸露焊盘 |
| 供应商设备封装： | 24-TSSOP 裸露焊盘 |
| 包装： | 管件 |
3
FN9134.2
November 18, 2005
Block Diagram
OUTPUT1
DRIVERS
GATE CONTROL
LOGIC
DEAD-TIME
CONTROL
POWER
ON
RESET
AND CONTROL
VCC
BOOT1
UGATE1
LGATE1
SS1/EN1
BOOT2
UGATE2
LGATE2
SS2/EN2
VCC5
30礎
VCC5
VCC12
REFIN
FB2
COMP2
FB1
FS/SYNC
CLOCK AND
SAWTOOTH
GENERATOR
FB3
DRIVE3
PGND
GND
REFERENCE
COMP1
SS3/EN3
VCC5
REFOUT
0.6V
3.3V
3.3V
5.8V
3.3V
VCC5
VREF
0.6V
0.6V
PGOOD
3.3V
1-2 CLOCK
CYCLE
FILTER
PGOOD =
all 3 SS ramps done
with no COMP short
MONITOR
COMP PINS
FOR SHORTS
IF SHORT > FILTER,
SHUT DOWN ALL
3 OUTPUTS
BIAS CURRENT
OUTPUT2
DRIVERS
GATE CONTROL
LOGIC
DEAD-TIME
CONTROL
FIGURE 1. BLOCK DIAGRAM
30礎
30礎
ISL6534
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