参数资料
型号: ISL6740IB-T
厂商: Intersil
文件页数: 24/28页
文件大小: 0K
描述: IC REG CTRLR PWM VM 16-SOIC
标准包装: 2,500
PWM 型: 电压模式
输出数: 2
频率 - 最大: 2MHz
占空比: 100%
电源电压: 9 V ~ 16 V
降压:
升压:
回扫:
反相:
倍增器:
除法器:
Cuk:
隔离:
工作温度: -40°C ~ 105°C
封装/外壳: 16-SOIC(0.154",3.90mm 宽)
包装: 带卷 (TR)
ISL6740, ISL6741
The following compensation components were selected
R 23 = 9.53k Ω
R 24 = 2.49k Ω
R 4 = 499 Ω
R 21 = 4.22k Ω
C 22 = 1nF
C 20 = 82pF
C 19 = 0.22 μ F
From (Equations 27, 28, 29 and 30), the poles and zeroes are:
The gain and phase plots combined with the opto coupler’s
transfer characteristics appear in Figures 24A and 24B:
30
20
10
0
f z1 = 171Hz
-10
10
100
1?10 3
1?10 4
1?10 5
1?10 6
f z2 = 16.7kHz
f p2 = 460kHz
f p3 = 319kHz
The calculated gain and phase plots of the error amplifier appear
below using an ideal op amp.
20
10
FREQUENCY (Hz)
FIGURE 24A. EA PLUS OPTO COUPLER GAIN
90
45
0
-45
-90
-135
0
-180
10
100
1?10 3
1?10 4
1?10 5
1?10 6
FREQUENCY (Hz)
FIGURE 24B. EA PLUS OPTO COUPLER GAIN
-10
10
100
1?10 3
1?10 4
1?10 5
1?10 6
90
45
0
-45
FREQUENCY (Hz)
FIGURE 23A. IDEAL ERROR AMPLIFIER GAIN
Using the control-to-output transfer function combined with the
EA transfer function, the loop gain and phase may be predicted.
The predicted loop gain and phase margin of the converter
appear in Figures 25A and 25B:
50
40
30
20
10
0
-10
-20
-30
-90
10
100
1?10 3 1?10 4
FREQUENCY (Hz)
1?10 5
1?10 6
-40
-50
100
1?10 3
1?10 4
1?10 5
FIGURE 23B. IDEAL ERROR AMPLIFIER PHASE
24
FREQUENCY (Hz)
FIGURE 25A. PREDICTED LOOP GAIN
FN9111.6
December 2, 2011
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PDF描述
ISL6740IB IC REG CTRLR PWM VM 16-SOIC
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ISL6740IBZ-T 功能描述:IC REG CTRLR PWM VM 16-SOIC RoHS:是 类别:集成电路 (IC) >> PMIC - 稳压器 - DC DC 切换控制器 系列:- 产品培训模块:Lead (SnPb) Finish for COTS Obsolescence Mitigation Program 标准包装:2,500 系列:- PWM 型:电流模式 输出数:1 频率 - 最大:275kHz 占空比:50% 电源电压:18 V ~ 110 V 降压:无 升压:无 回扫:无 反相:无 倍增器:无 除法器:无 Cuk:无 隔离:是 工作温度:-40°C ~ 85°C 封装/外壳:8-SOIC(0.154",3.90mm 宽) 包装:带卷 (TR)
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