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参数资料
| 型号： | ISL6754AAZA-T |
| 厂商： | Intersil |
| 文件页数： | 7/19页 |
| 文件大小： | 0K |
| 描述： | IC REG CTRLR PWM CM/VM 20-QSOP |
| 标准包装： | 2,500 |
| PWM 型： | 电流/电压模式 |
| 输出数： | 6 |
| 频率 - 最大： | 2MHz |
| 占空比： | 100% |
| 电源电压： | 9 V ~ 16 V |
| 降压： | 无 |
| 升压： | 无 |
| 回扫： | 无 |
| 反相： | 无 |
| 倍增器： | 无 |
| 除法器： | 无 |
| Cuk： | 无 |
| 隔离： | 无 |
| 工作温度： | -40°C ~ 105°C |
| 封装/外壳： | 20-SSOP（0.154"，3.90mm 宽） |
| 包装： | 带卷 (TR) |
ISL6754
Electrical Specifications
Recommended operating conditions unless otherwise noted. Refer to “Functional Block Diagram” on page 2
and “Typical Application schematics” beginning on page 3. 9V < V DD < 20V, RTD = 10.0k Ω , CT = 470pF,
T A = -40°C to +105°C, Typical values are at T A = +25°C; Parameters with MIN and/or MAX limits are 100%
tested at +25°C, unless otherwise specified. Temperature limits established by characterization and are not
production tested. (Continued)
PARAMETER
TEST CONDITIONS
MIN
TYP
MAX
UNITS
SOFT-START
Charging Current
SS Clamp Voltage
SS Discharge Current
Reset Threshold Voltage
SS = 3V
SS = 2V
T A = +25°C
-60
4.410
10
0.23
-70
4.500
-
0.27
-80
4.590
-
0.33
μ A
V
mA
V
OUTPUT
High Level Output Voltage (VOH)
Low Level Output Voltage (VOL)
Rise Time
Fall Time
UVLO Output Voltage Clamp
Output Delay/Advance Range
OUTLLN/OUTLRN relative to OUTLL/OUTLR
Delay/Advance Control Voltage Range
OUTLLN/OUTLRN relative to OUTLL/OUTLR
I OUT = -10mA, V DD - VOH
I OUT = 10mA, VOL - GND
C OUT = 220pF, V DD = 15V (Note 4)
C OUT = 220pF, V DD = 15V (Note 4)
V DD = 7V, I LOAD = 1mA (Note 6)
V ADJ = 2.50V
V ADJ < 2.425V
V ADJ > 2.575V
OUTLxN Delayed
OUTLxN Advanced
-
-
-
-
-
-
-40
40
2.575
0
0.5
0.5
110
90
-
2
-
-
-
-
1.0
1.0
200
150
1.25
-
-300
300
5.000
2.425
V
V
ns
ns
V
ns
ns
ns
V
V
V ADJ Delay Time
T A = +25°C (OUTLx Delayed) (Note 7)
V ADJ = 0
V ADJ = 0.5V
V ADJ = 1.0V
V ADJ = 1.5V
V ADJ = 2.0V
-
-
-
-
-
300
105
70
55
50
-
-
-
-
-
ns
ns
ns
ns
ns
T A = +25°C (OUTLxN Delayed)
V ADJ = V REF
V ADJ = V REF - 0.5V
V ADJ = V REF - 1.0V
V ADJ = V REF - 1.5V
V ADJ = V REF - 2.0V
-
-
-
-
-
300
100
68
55
48
-
-
-
-
-
ns
ns
ns
ns
ns
THERMAL PROTECTION
Thermal Shutdown
Thermal Shutdown Clear
Hysteresis, Internal Protection
(Note 4)
(Note 4)
(Note 4)
-
-
-
140
125
15
-
-
-
°C
°C
°C
NOTES:
4. Limits established by characterization and are not production tested.
5. This is the maximum duty cycle achievable using the specified values of RTD and CT. Larger or smaller maximum duty cycles may be obtained
using other values for these components. See Equations 1 through 3.
6. Adjust V DD below the UVLO stop threshold prior to setting at 7V.
7. When OUTLx is delayed relative to OUTLxN (V ADJ < 2.425V), the delay duration as set by V ADJ should not exceed 90% of the CT discharge
time (deadtime) as determined by CT and RTD.
7
FN6754.1
September 29, 2008
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