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参数资料
| 型号： | ISL88002IH22Z-T7A |
| 厂商： | Intersil |
| 文件页数： | 7/11页 |
| 文件大小： | 0K |
| 描述： | IC VOLT SUPERVISOR 2.19V SOT23-3 |
| 产品培训模块： | Solutions for Industrial Control Applications |
| 标准包装： | 250 |
| 类型： | 简单复位/加电复位 |
| 监视电压数目： | 1 |
| 输出： | 开路漏极或开路集电极 |
| 复位： | 低有效 |
| 复位超时： | 最小为 140 ms |
| 电压 - 阀值： | 2.19V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | TO-236-3，SC-59，SOT-23-3 |
| 供应商设备封装： | SOT-23-3 |
| 包装： | 带卷 (TR) |
ISL88001, ISL88002, ISL88003
V TH/ V POR
V DD
1V
t POR
t RPD
t POR
RST
FIGURE 2. VOLTAGE MONITORING TIMING DIAGRAM
Power-On Reset (POR)
Applying power to the ISL88001, ISL88002, ISL88003
activates a POR circuit, which asserts reset once V DD = 1 V.
(i.e. RST goes LOW). This provides several benefits:
? It prevents the system microprocessor from starting to
operate with insufficient voltage.
? It prevents the processor from operating prior to
stabilization of the oscillator.
? It ensures that the monitored device is held out of
operation until internal registers are properly loaded.
The reset signal remains asserted until V DD rises above the
minimum voltage sense level for time period t POR . This
ensures that the V DD voltage has stabilized.
Optional V DD de-coupling capacitance can be added to filter
transients if needed.
See Figures 13 and 14 illustrating the available evaluation
platform, ISL88001/2/3EVAL1Z. This evaluation board is
shipped with the many released variants loosely packed and
the 4.6V threshold variants mounted for immediate
evaluation.
? It allows time for an FPGA to download its configuration
prior to initialization of the circuit.
Parametric Performance
VDD
VDD
RST
RST
FIGURE 3. ISL88001 RST t POR ~144ms
7
RST
FIGURE 4. ISL88002 RST t POR ~155ms, R PU = 5k Ω
FN6174.2
May 29, 2012
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PDF描述 |
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