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参数资料
| 型号： | ISL9000IRBJZ-T |
| 厂商： | Intersil |
| 文件页数： | 8/11页 |
| 文件大小： | 0K |
| 描述： | IC REG LDO 1.5V/2.8V .3A 10-DFN |
| 标准包装： | 1 |
| 稳压器拓扑结构： | 正，固定式 |
| 输出电压： | 1.5V，2.8V |
| 输入电压： | 2.3 V ~ 6.5 V |
| 电压 - 压降（标准）： | -，0.25V @ 300mA |
| 稳压器数量： | 2 |
| 电流 - 输出： | 300mA（最小） |
| 电流 - 限制（最小）： | 350mA |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 10-VFDFN 裸露焊盘 |
| 供应商设备封装： | 10-DFN（3x3） |
| 包装： | 剪切带 (CT) |
| 其它名称： | ISL9000IRBJZ-TCT |
ISL9000
Pin Description
PIN
PIN
NUMBER
1
NAME
VIN
TYPE
Analog I/O
Supply Voltage/LDO Input:
DESCRIPTION
Connect a 1μF capacitor to GND.
2
EN1
Low Voltage Compatible
LDO-1 Enable.
CMOS Input
3
EN2
Low Voltage Compatible
LDO-2 Enable.
CMOS Input
4
CBYP
Analog I/O
Reference Bypass Capacitor Pin:
Optionally connect capacitor of value 0.01μF to 1μF between this pin and GND to tune in the
desired noise and PSRR performance.
5
CPOR
Analog I/O
POR2 Delay Setting Capacitor Pin:
Connect a capacitor between this pin and GND to delay the POR2 output release after LDO-2
output reaches 94% of its specified voltage level. (200ms delay per 0.01μF).
6
GND
Ground
GND is the connection to system ground. Connect to PCB Ground plane.
7
8
POR1
POR2
Open Drain Output (1mA) Open-drain POR Output for LDO-1 (active-low):
Internally connected to VO1 through 100k Ω resistor.
Open Drain Output (1mA) Open-drain POR Output for LDO-2 (active-low):
Internally connected to VO2 through 100k Ω resistor.
9
VO2
Analog I/O
LDO-2 Output:
Connect capacitor of value 1μF to 10μF to GND (1μF recommended).
10
VO1
Analog I/O
LDO-1 Output:
Connect capacitor of value 1μF to 10μF to GND (1μF recommended).
Typical Application
ISL9000
VIN (2.3 TO 6.5V)
ENABLE1
ON
1
2
VIN
EN1
VO1
VO2
10
9
VOUT 1
VOUT 2
OFF ON
ENABLE2
3
EN2
POR2
8
VOUT 2 OK
RESET 2
OFF
4
CBYP
POR1
7
VOUT 2 TOO LOW (200ms delay,
C3 = 0.01μF)
5
CPOR
GND
6
VOUT 1 OK
RESET 1
C1
C2
C3
C4
C5
VOUT 1 TOO LOW (2ms delay)
C1, C4, C5: 1μF X5R ceramic capacitor
C2: 0.1μF X7R ceramic capacitor
C3: 0.01μF X7R ceramic capacitor
8
FN9217.4
March 11, 2008
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