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参数资料
| 型号： | ISL9492ERZ |
| 厂商： | Intersil |
| 文件页数： | 8/21页 |
| 文件大小： | 0K |
| 描述： | IC REG SGL LNB CONTROL 28TQFN |
| 标准包装： | 75 |
| 应用： | 转换器，卫星信号接收机顶盒设计 |
| 输入电压： | 8 V ~ 14 V |
| 输出数： | 1 |
| 输出电压： | 13.5 V ~ 20 V |
| 工作温度： | -20°C ~ 85°C |
| 安装类型： | * |
| 封装/外壳： | * |
| 供应商设备封装： | * |
| 包装： | * |
ISL9492
Electrical Specifications V CC = 12V, T A = -20°C to +85°C, unless otherwise noted. Typical values are at T A = +25°C. EN = 1,
VTOP = 0, VBOT = 0, ENT = 0, V OUT Load = 100mA, unless otherwise noted. See “ISL9492 Software Description” on page 16 for I 2 C access to
the system. Boldface limits apply over the operating temperature range, -20°C to +85°C. (Continued)
MIN
MAX
PARAMETER
SYMBOL
TEST CONDITIONS
(Note 7) (Note 8)
TYP
(Note 8) UNITS
Line Regulation
Load Regulation
V CC = 8V to 14V; V OUT = 13V @ 350mA
V CC = 8V to 14V; V OUT = 18V @ 350mA
V OUT Load = 0mA to 350mA
V OUT Load = 0mA to 750mA
P
P
P
P
-
-
-
-
4
4
50
100
40
60
80
200
mV
mV
mV
mV
Current Limiting
Cable Fault CABF Threshold
Back-Biased Current
I MAX
I CAB
ISELH = 0, ISELL = 0, DCL bit = 0 (Note 10)
ISELH = 1, ISELL = 0, DCL bit = 0 (Note 10)
ISELH = 0, ISELL = 1, DCL bit = 0 (Note 10)
ISELH = 1, ISELL = 1, DCL bit = 0 (Note 10)
V OUT = 20V, No Tone
V OUT = 21V from External Source
P
P
P
P
P
P
850
600
710
370
2
-
950
670
790
400
20
-
1050
740
870
450
50
10
mA
mA
mA
mA
mA
mA
TONE OSCILLATOR (TONE) (Note 8)
Tone Frequency
Tone Amplitude
Tone Duty Cycle
Tone Rise or Fall Time
f tone
V tone
dc tone
t r , t f
ENT = 1
ENT = 1, with Proper DiSEqC Tank Circuit
ENT = 1
ENT = 1
P
P
P
P
20
500
-
5
22
680
50
10
24
800
-
14
kHz
mV
%
μs
TONE DECODER (TDIN, TDOUT)
Frequency Capture Range
Input Impedance
Ftdin
Zdet
P
F
18
-
-
8.6
26
-
kHz
k Ω
Detector Output Voltage
Detector Output Leakage (Open Drain)
Tone Decoder Rx Threshold (Note 10)
Tone Decoder Tx Threshold (Note 10)
V tdout_L
I tdout_H
V RXth
V TXth
Tone Present, Sink Current = 3mA
Tone Absent
TTH bit = 0 and TXT pin = 0
TTH bit= 1 or TXT pin = 1
P
P
P
P
-
-
200
400
-
-
-
-
0.4
10
-
-
V
μA
mV P-P
mV P-P
LOGIC INTERFACE (INPUT = EXTM, SVTOP, ADD0, ADD1, TXT, SCL, SDA, OUTPUT = FLT)
Input Logic LOW
Input Logic HIGH
Input Current
Input Pull-down Resistance
F
F
F
F
-
2.0
-
-
-
-
25
200
0.8
-
-
-
V
V
μA
k Ω
Output Logic LOW
Output Logic High Leakage (Open Drain)
Fault Detected, Sink Current = 3mA
No Fault
F
F
-
-
-
-
0.4
10
V
μA
NOTES:
7. F = Functional check; P = Probe or final test
8. Compliance to datasheet limits is assured by one or more methods: production test, characterization and/or design.
9. Output voltage can only be maintained in regulation if the input voltage is within the specified range.
8
FN6547.1
March 17, 2011
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