- 您现在的位置：买卖IC网 > PDF目录19738 > ISPLSI 2128VE-250LB100 (Lattice Semiconductor Corporation)IC PLD ISP 64I/O NS 100CABGA PDF资料下载
参数资料
| 型号： | ISPLSI 2128VE-250LB100 |
| 厂商： | Lattice Semiconductor Corporation |
| 文件页数： | 18/20页 |
| 文件大小： | 0K |
| 描述： | IC PLD ISP 64I/O NS 100CABGA |
| 标准包装： | 184 |
| 系列： | ispLSI® 2000VE |
| 可编程类型： | 系统内可编程 |
| 最大延迟时间 tpd(1)： | 4.0ns |
| 电压电源 - 内部： | 3 V ~ 3.6 V |
| 逻辑元件/逻辑块数目： | 32 |
| 宏单元数： | 128 |
| 门数： | 6000 |
| 输入/输出数： | 128 |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 100-LFBGA |
| 供应商设备封装： | 100-CABGA（10x10） |
| 包装： | 托盘 |
| 其它名称： | ISPLSI2128VE-250LB100 |
Specifications ispLSI 2128VE
7
USE
2128VE-250
FOR
NEW
DESIGNS
Internal Timing Parameters1
Over Recommended Operating Conditions
tio
1. Internal Timing Parameters are not tested and are for reference only.
2. Refer to Timing Model in this data sheet for further details.
3. The XOR adjacent path can only be used by hard macros.
Table 2-0036A/2128VE
v.1.0
Inputs
UNITS
DESCRIPTION
#
2
PARAMETER
20 Input Buffer Delay
ns
tdin
21 Dedicated Input Delay
ns
tgrp
22 GRP Delay
ns
GLB
t1ptxor
25 1 Product Term/XOR Path Delay
ns
t20ptxor
26 20 Product Term/XOR Path Delay
ns
txoradj
27 XOR Adjacent Path Delay
ns
tgbp
28 GLB Register Bypass Delay
ns
tgsu
29 GLB Register Setup Time before Clock
ns
tgh
30 GLB Register Hold Time after Clock
ns
tgco
31 GLB Register Clock to Output Delay
ns
3
tgro
32 GLB Register Reset to Output Delay
ns
tptre
33 GLB Product Term Reset to Register Delay
ns
tptoe
34 GLB Product Term Output Enable to I/O Cell Delay
ns
tptck
35 GLB Product Term Clock Delay
ns
ORP
tob
38 Output Buffer Delay
ns
tsl
39 Output Slew Limited Delay Adder
ns
GRP
t4ptbpc
23 4 Product Term Bypass Path Delay (Combinatorial)
ns
t4ptbpr
24 4 Product Term Bypass Path Delay (Registered)
ns
torp
36 ORP Delay
ns
torpbp
37 ORP Bypass Delay
ns
Outputs
toen
40 I/O Cell OE to Output Enabled
ns
todis
41 I/O Cell OE to Output Disabled
ns
tgoe
42 Global Output Enable
ns
tgy0
43 Clock Delay, Y0 to Global GLB Clock Line (Ref. clock)
ns
tgy1/2
44 Clock Delay, Y1 or Y2 to Global GLB Clock Line
ns
Clocks
tgr
45 Global Reset to GLB
-180
MIN. MAX.
0.5
1.1
0.6
3.4
0.0
—
0.3
0.6
4.3
5.9
4.0
1.6
2.0
1.9
2.4
1.4
0.4
3.0
2.0
1.2
1.4
4.4
—
1.2
2.3
—
1.0
—
1.2
1.4
—
-250
MIN. MAX.
0.5
0.7
0.2
2.8
0.0
—
0.2
0.3
3.7
2.9
3.6
1.4
2.0
1.5
2.0
1.1
0.4
2.4
1.6
1.0
1.2
3.9
—
0.8
1.7
—
0.8
—
1.0
1.2
—ns
Global Reset
相关PDF资料 |
PDF描述 |
|---|---|
| EEC18DREF | CONN EDGECARD 36POS .100 EYELET |
| ECC22DJXN | CONN EDGECARD 44PS .100 PRESSFIT |
| ISPLSI 2128A-80LQN160 | IC PLD ISP 128I/O 15NS 160PQFP |
| ECC22DJCN | CONN EDGECARD 44PS .100 PRESSFIT |
| TOP257PN | IC OFFLINE SWIT PROG OVP 8DIP |
相关代理商/技术参数 |
参数描述 |
|---|---|
| ISPLSI2128VE-250LB100 | 功能描述:CPLD - 复杂可编程逻辑器件 RoHS:否 制造商:Lattice 系列: 存储类型:EEPROM 大电池数量:128 最大工作频率:333 MHz 延迟时间:2.7 ns 可编程输入/输出端数量:64 工作电源电压:3.3 V 最大工作温度:+ 90 C 最小工作温度:0 C 封装 / 箱体:TQFP-100 |
| ISPLSI2128VE250LB100I | 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:3.3V In-System Programmable SuperFAST⑩ High Density PLD |
| ISPLSI2128VE250LB208 | 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:3.3V In-System Programmable SuperFAST⑩ High Density PLD |
| ISPLSI2128VE-250LB208 | 功能描述:CPLD - 复杂可编程逻辑器件 RoHS:否 制造商:Lattice 系列: 存储类型:EEPROM 大电池数量:128 最大工作频率:333 MHz 延迟时间:2.7 ns 可编程输入/输出端数量:64 工作电源电压:3.3 V 最大工作温度:+ 90 C 最小工作温度:0 C 封装 / 箱体:TQFP-100 |
| ISPLSI2128VE250LB208I | 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:3.3V In-System Programmable SuperFAST⑩ High Density PLD |
发布紧急采购，3分钟左右您将得到回复。