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参数资料
| 型号： | IT80C52TXXX-16R |
| 厂商： | ATMEL CORP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 16 MHz, MICROCONTROLLER, PQFP44 |
| 封装： | 1 MM HEIGHT, TQFP-44 |
| 文件页数： | 381/477页 |
| 文件大小： | 10096K |
| 代理商： | IT80C52TXXX-16R |
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54
32059L–AVR32–01/2012
AT32UC3B
9.6.4
PLL Control Register
Name:
PLL0,1
Access Type:
Read/Write
Offset:
0x020, 0x024
Reset Value:
0x00000000
PLLCOUNT: PLL Count
Specifies the number of slow clock cycles before ISR:LOCKn will be set after PLLn has been written, or after PLLn has been
automatically re-enabled after exiting a sleep mode.
PLLMUL: PLL Multiply Factor
PLLDIV: PLL Division Factor
These fields determine the ratio of the ouput frequency of the internal VCO of the PLL (fVCO) to the source oscillator frequency:
fVCO = (PLLMUL+1)/(PLLDIV) * fOSC if PLLDIV > 0.
fVCO = 2 * (PLLMUL+1) * fOSC if PLLDIV = 0.
If PLLOPT[1] bit is set to 0: fPLL = fVCO.
If PLLOPT[1] bit is set to 1: fPLL = fVCO / 2.
Note that the PLLMUL field cannot be equal to 0 or 1, or the behavior of the PLL will be undefined.
PLLDIV gives also the input frequency of the PLL (fIN):
if the PLLDIV field is set to 0: fIN = fOSC.
if the PLLDIV field is greater than 0: fIN = fOSC / (2 * PLLDIV).
PLLOPT: PLL Option
Select the operating range for the PLL.
PLLOPT[0]: Select the VCO frequency range.
PLLOPT[1]: Enable the extra output divider.
PLLOPT[2]: Disable the Wide-Bandwidth mode (Wide-Bandwidth mode allows a faster startup time and out-of-lock time).
31
30
29
28
27
26
25
24
-
PLLCOUNT
23
22
21
20
19
18
17
16
-
---
PLLMUL
15
14
13
12
11
10
9
8
-
---
PLLDIV
76
543
21
0
-
PLLOPT
PLLOSC
PLLEN
相关PDF资料 |
PDF描述 |
|---|---|
| ID80C52TXXX-16D | 8-BIT, MROM, 16 MHz, MICROCONTROLLER, CDIP40 |
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参数描述 |
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