参数资料
| 型号： | KAD5512HP-17Q72 |
| 厂商： | Intersil |
| 文件页数： | 16/34页 |
| 文件大小： | 0K |
| 描述： | IC ADC 12BIT 170MSPS SGL 72-QFN |
| 产品培训模块： | High-Speed Analog-to-Digital Converters |
| 标准包装： | 1 |
| 系列： | FemtoCharge™ |
| 位数： | 12 |
| 采样率（每秒）： | 170M |
| 数据接口： | 串行，SPI? |
| 转换器数目： | 1 |
| 功率耗散（最大）： | 406mW |
| 电压电源： | 单电源 |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 72-VFQFN 裸露焊盘 |
| 供应商设备封装： | 72-QFN（10x10） |
| 包装： | 托盘 |
| 输入数目和类型： | 1 个差分，单极 |
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23
FN6808.3
October 1, 2009
SPI Physical Interface
The serial clock pin (SCLK) provides synchronization for the
data transfer. By default, all data is presented on the serial
data input/output (SDIO) pin in three-wire mode. The state of
the SDIO pin is set automatically in the communication
protocol (described in the following). A dedicated serial data
output pin (SDO) can be activated by setting 0x00[7] high to
allow operation in four-wire mode.
The SPI port operates in a half duplex master/slave
configuration, with the KAD5512HP functioning as a slave.
FIGURE 35. SPI WRITE
tS
tHI
tCLK
tLO
R/W
W1
W0
A12 A11 A10
A9
A8
A7
D5
D4
D3
D2
D1
D0
tH
tDHW
tDSW
SPI WRITE
CSB
SCLK
SDIO
FIGURE 36. SPI READ
(3 WIRE MODE)
(4 WIRE MODE)
R/W
W1
W0
A12 A11 A10
A9
A2
A1
D7
D6
D3
D2
D1
D7
D3
D2
D1 D0
A0
WRITING A READ COMMAND
READING DATA
D0
tH
tDHR
tDVR
SPI READ
tHI
tCLK
tLO
tDHW
tDSW
tS
CSB
SCLK
SDIO
SDO
FIGURE 37. 2-BYTE TRANSFER
CSB
SCLK
SDIO
INSTRUCTION/ADDRESS
DATA WORD 1
DATA WORD 2
CSB STALLING
FIGURE 38. N-BYTE TRANSFER
CSB
SCLK
SDIO
INSTRUCTION/ADDRESS
DATA WORD 1
DATA WORD N
LAST LEGAL
CSB STALLING
KAD5512HP
相关PDF资料 |
PDF描述 |
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| KAD5512P | 制造商:INTERSIL 制造商全称:Intersil Corporation 功能描述:Low Power 12-Bit, 250/210/170/125MSPS ADC |
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