参数资料
| 型号： | KS8993ML |
| 厂商： | Micrel Inc |
| 文件页数： | 52/85页 |
| 文件大小： | 0K |
| 描述： | IC SWITCH 10/100 3PORT 128PQFP |
| 标准包装： | 66 |
| 系列： | * |
| 类型： | * |
| 应用： | * |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 128-BFQFP |
| 供应商设备封装： | 128-PQFP（14x20） |
| 包装： | 散装 |
| 配用： | 576-1016-ND - BOARD EVAL FOR KS8993ML |
| 其它名称： | 576-1015 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页当前第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页
Micrel, Inc.
KS8993M/ML/MI
April 2005
56
M9999-041205
Register 18 (0x12): Port 1 Control 2
Register 34 (0x22): Port 2 Control 2
Register 50 (0x32): Port 3 Control 2
Bit
Name
R/W
Description
Default
7
Reserved
0
6
Ingress VLAN
filtering
R/W
= 1, the switch will discard packets whose VID
port membership in VLAN table bits [18:16] does
not include the ingress port.
= 0, no ingress VLAN filtering.
0
5
Discard non
PVID packets
R/W
= 1, the switch will discard packets whose VID
does not match ingress port default VID.
= 0, no packets will be discarded
0
4
Force flow
control
R/W
= 1, will always enable flow control on the port,
regardless of AN result.
= 0, the flow control is enabled based on AN
result.
Pin value during
reset:
For port 1,
P1FFC pin
For port 2,
P2FFC pin
For port 3, this
bit has no
meaning. Flow
control is
controlled by
Reg. 6, bit 5.
3
Back pressure
enable
R/W
= 1, enable port’s half duplex back pressure
= 0, disable port’s half duplex back pressure.
Pin value during
reset:
BPEN pin
2
Transmit
enable
R/W
= 1, enable packet transmission on the port
= 0, disable packet transmission on the port
1
Receive
enable
R/W
= 1, enable packet reception on the port
= 0, disable packet reception on the port
1
0
Learning
disable
R/W
= 1, disable switch address learning capability
= 0, enable switch address learning
0
Note: Bits [2:0] are used for spanning tree support (see page 33).
Register 19 (0x13): Port 1 Control 3
Register 35 (0x23): Port 2 Control 3
Register 51 (0x33): Port 3 Control 3
Bit
Name
R/W
Description
Default
7-0
Default tag
[15:8]
R/W
Port’s default tag, containing
7-5 : User priority bits
4 : CFI bit
3-0 : VID[11:8]
0x00
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