参数资料
| 型号： | KSZ8051MLL TR |
| 厂商： | Micrel Inc |
| 文件页数： | 25/48页 |
| 文件大小： | 0K |
| 描述： | TXRX PHY 10/T100 3.3V MII 48LQFP |
| 标准包装： | 1,000 |
| 类型： | PHY 收发器 |
| 驱动器/接收器数： | 1/1 |
| 规程： | MII |
| 电源电压： | 1.8V，2.5V，3.3V |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 48-LQFP |
| 供应商设备封装： | 48-LQFP（7x7） |
| 包装： | 带卷 (TR) |
| 配用： | 576-3864-ND - BOARD EVALUATION FOR KSZ8051MLL |
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MCP413X/415X/423X/425X
DS22060B-page 34
2008 Microchip Technology Inc.
4.2.1.1
Status (STATUS) Register
This register contains 5 status bits. These bits show the
state of the Shutdown bit. The STATUS register can be
accessed via the READ commands. Register 4-1
describes each STATUS register bit.
The STATUS register is placed at Address 05h.
REGISTER 4-1:
STATUS REGISTER
R-1
R-0
R-x
D8:D5
RESV
SHDN
RESV
bit 7
bit 0
Legend:
R = Readable bit
W = Writable bit
U = Unimplemented bit, read as ‘0’
-n = Value at POR
‘1’ = Bit is set
‘0’ = Bit is cleared
x = Bit is unknown
bit 8-5
D8:D5: Reserved. Forced to “1”
bit 4-2
RESV: Reserved
bit 1
SHDN: Hardware Shutdown pin Status bit (Refer to Section 5.3 “Shutdown” for further information)
This bit indicates if the Hardware shutdown pin (SHDN) is low. A hardware shutdown disconnects the
Terminal A and forces the wiper (Terminal W) to Terminal B (see Figure 5-2). While the device is in Hard-
ware Shutdown (the SHDN pin is low) the serial interface is operational so the STATUS register may be
read.
1
= MCP4XXX is in the Hardware Shutdown state
0
= MCP4XXX is NOT in the Hardware Shutdown state
bit 0
RESV: Reserved
相关PDF资料 |
PDF描述 |
|---|---|
| KSZ8051MLLI TR | TXRX PHY 10/T100 3.3V MII 48LQFP |
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参数描述 |
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| KSZ8051MNLI TR | 功能描述:以太网 IC 3.3V, 10Base-T/100Base-TX Physical Layer Transceiver with MII support (32-QFN, Industrial Grade) RoHS:否 制造商:Micrel 产品:Ethernet Switches 收发器数量:2 数据速率:10 Mb/s, 100 Mb/s 电源电压-最大:1.25 V, 3.45 V 电源电压-最小:1.15 V, 3.15 V 最大工作温度:+ 85 C 封装 / 箱体:QFN-64 封装:Tray |
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