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参数资料
| 型号： | LC4032ZC-75MN56C |
| 厂商： | Lattice Semiconductor Corporation |
| 文件页数： | 28/99页 |
| 文件大小： | 0K |
| 描述： | IC CPLD 32MACROCELLS 56CSBGA |
| 标准包装： | 1,800 |
| 系列： | ispMACH® 4000Z |
| 可编程类型： | 系统内可编程 |
| 最大延迟时间 tpd(1)： | 7.5ns |
| 电压电源 - 内部： | 1.7 V ~ 1.9 V |
| 逻辑元件/逻辑块数目： | 2 |
| 宏单元数： | 32 |
| 输入/输出数： | 32 |
| 工作温度： | 0°C ~ 90°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 56-TFBGA |
| 供应商设备封装： | 56-CSBGA（6x6） |
| 包装： | 托盘 |
| 其它名称： | 220-1652 LC4032ZC-75MN56C-ND |
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Lattice Semiconductor
ispMACH 4000V/B/C/Z Family Data Sheet
ispMACH 4000V/B/C Internal Timing Parameters (Cont.)
Over Recommended Operating Conditions
Parameter
Description
-2.5
-2.7
-3
-3.5
Units
Propagation Delay through
t PDLi
t SRi
t SRR
Transparent Latch to Output/
Feedback MUX
Asynchronous Reset or Set to
Output/Feedback MUX Delay
Asynchronous Reset or Set
Recovery Time
—
0.28
1.67
0.25
—
—
—
0.28
1.67
0.25
—
—
—
0.28
1.67
0.25
—
—
—
0.28
1.67
0.25
—
—
ns
ns
ns
Control Delays
t BCLK
t PTCLK
t BSR
t PTSR
t GPTOE
t PTOE
GLB PT Clock Delay
Macrocell PT Clock Delay
Block PT Set/Reset Delay
Macrocell PT Set/Reset Delay
Global PT OE Delay
Macrocell PT OE Delay
—
—
—
—
—
—
1.12
0.87
1.83
1.11
2.83
1.83
—
—
—
—
—
—
1.12
0.87
1.83
1.41
4.13
2.13
—
—
—
—
—
—
1.12
0.87
1.83
1.51
5.33
2.33
—
—
—
—
—
—
1.12
0.87
1.83
1.61
5.33
2.83
ns
ns
ns
ns
ns
ns
Timing v.3.2
Note: Internal Timing Parameters are not tested and are for reference only. Refer to the Timing Model in this data sheet for further details.
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