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参数资料
| 型号： | LC4512C-5FTN256I |
| 厂商： | Lattice Semiconductor Corporation |
| 文件页数： | 33/99页 |
| 文件大小： | 0K |
| 描述： | IC CPLD 512MACROCELLS 256FTBGA |
| 标准包装： | 90 |
| 系列： | ispMACH® 4000C |
| 可编程类型： | 系统内可编程 |
| 最大延迟时间 tpd(1)： | 5.0ns |
| 电压电源 - 内部： | 1.65 V ~ 1.95 V |
| 逻辑元件/逻辑块数目： | 32 |
| 宏单元数： | 512 |
| 输入/输出数： | 208 |
| 工作温度： | -40°C ~ 105°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 256-LBGA |
| 供应商设备封装： | 256-FTBGA（17x17） |
| 包装： | 托盘 |
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Lattice Semiconductor
ispMACH 4000V/B/C/Z Family Data Sheet
ispMACH 4000Z Internal Timing Parameters (Cont.)
Over Recommended Operating Conditions
-45
-5
-75
Parameter
Description
Min.
Max.
Min.
Max.
Min.
Max.
Units
In/Out Delays
t IN
t GOE
t GCLK_IN
t BUF
t EN
t DIS
Input Buffer Delay
Global OE Pin Delay
Global Clock Input Buffer Delay
Delay through Output Buffer
Output Enable Time
Output Disable Time
—
—
—
—
—
—
0.95
3.00
1.95
1.10
2.50
2.50
—
—
—
—
—
—
1.25
3.50
2.05
1.00
2.50
2.50
—
—
—
—
—
—
1.80
4.30
2.15
1.30
2.70
2.70
ns
ns
ns
ns
ns
ns
Routing/GLB Delays
t ROUTE
t MCELL
t INREG
t FBK
t PDb
t PDi
Delay through GRP
Macrocell Delay
Input Buffer to Macrocell Register Delay
Internal Feedback Delay
5-PT Bypass Propagation Delay
Macrocell Propagation Delay
—
—
—
—
—
—
2.25
0.65
1.00
0.35
0.20
0.45
—
—
—
—
—
—
2.05
0.65
1.00
0.05
0.70
0.65
—
—
—
—
—
—
2.50
1.00
1.00
0.05
1.90
1.00
ns
ns
ns
ns
ns
ns
Register/Latch Delays
t S
t S_PT
t ST
t ST_PT
t H
t HT
t SIR
t SIR_PT
t HIR
t HIR_PT
t COi
t CES
t CEH
t SL
t SL_PT
t HL
t GOi
t PDLi
t SRi
t SRR
D-Register Setup Time (Global Clock)
D-Register Setup Time (Product Term Clock)
T-Register Setup Time (Global Clock)
T-register Setup Time (Product Term Clock)
D-Register Hold Time
T-Resister Hold Time
D-Input Register Setup Time (Global Clock)
D-Input Register Setup Time (Product Term Clock)
D-Input Register Hold Time (Global Clock)
D-Input Register Hold Time (Product Term Clock)
Register Clock to Output/Feedback MUX Time
Clock Enable Setup Time
Clock Enable Hold Time
Latch Setup Time (Global Clock)
Latch Setup Time (Product Term Clock)
Latch Hold Time
Latch Gate to Output/Feedback MUX Time
Propagation Delay through Transparent Latch to Output/
Feedback MUX
Asynchronous Reset or Set to Output/Feedback MUX Delay
Asynchronous Reset or Set Recovery Delay
1.00
2.10
1.20
2.30
1.90
1.90
1.30
1.45
1.30
1.00
—
2.00
0.00
1.00
2.10
2.00
—
—
—
—
—
—
—
—
—
—
—
—
—
—
0.75
—
—
—
—
—
0.33
0.25
0.97
1.80
1.10
1.90
1.30
2.10
1.90
1.90
1.10
1.45
1.50
1.00
—
2.00
0.00
1.00
1.90
2.00
—
—
—
—
—
—
—
—
—
—
—
—
—
—
1.15
—
—
—
—
—
0.33
0.25
0.97
1.80
1.35
2.45
1.55
2.75
3.15
3.15
0.75
1.45
1.95
1.18
—
2.00
0.00
1.65
2.15
1.17
—
—
—
—
—
—
—
—
—
—
—
—
—
—
1.05
—
—
—
—
—
0.33
0.25
0.28
1.67
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
Control Delays
t BCLK
t PTCLK
t BSR
t PTSR
t GPTOE
GLB PT Clock Delay
Macrocell PT Clock Delay
GLB PT Set/Reset Delay
Macrocell PT Set/Reset Delay
Global PT OE Delay
—
—
—
—
—
1.55
1.55
1.83
1.83
4.30
—
—
—
—
—
1.55
1.55
1.83
1.83
4.20
—
—
—
—
—
1.25
1.25
1.83
2.72
3.50
ns
ns
ns
ns
ns
33
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PDF描述 |
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参数描述 |
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| LC4512C-5T176I | 功能描述:CPLD - 复杂可编程逻辑器件 PROGRAMMABLE SUPER FAST HI DENSITY PLD RoHS:否 制造商:Lattice 系列: 存储类型:EEPROM 大电池数量:128 最大工作频率:333 MHz 延迟时间:2.7 ns 可编程输入/输出端数量:64 工作电源电压:3.3 V 最大工作温度:+ 90 C 最小工作温度:0 C 封装 / 箱体:TQFP-100 |
| LC4512C-5TN176C | 功能描述:CPLD - 复杂可编程逻辑器件 PROGRAMMABLE SUPER FAST HI DENSITY PLD RoHS:否 制造商:Lattice 系列: 存储类型:EEPROM 大电池数量:128 最大工作频率:333 MHz 延迟时间:2.7 ns 可编程输入/输出端数量:64 工作电源电压:3.3 V 最大工作温度:+ 90 C 最小工作温度:0 C 封装 / 箱体:TQFP-100 |
| LC4512C-5TN176I | 功能描述:CPLD - 复杂可编程逻辑器件 PROGRAMMABLE SUPER FAST HI DENSITY PLD RoHS:否 制造商:Lattice 系列: 存储类型:EEPROM 大电池数量:128 最大工作频率:333 MHz 延迟时间:2.7 ns 可编程输入/输出端数量:64 工作电源电压:3.3 V 最大工作温度:+ 90 C 最小工作温度:0 C 封装 / 箱体:TQFP-100 |
| LC4512C-75F256C | 功能描述:CPLD - 复杂可编程逻辑器件 PROGRAMMABLE SUPER FAST HI DENSITY PLD RoHS:否 制造商:Lattice 系列: 存储类型:EEPROM 大电池数量:128 最大工作频率:333 MHz 延迟时间:2.7 ns 可编程输入/输出端数量:64 工作电源电压:3.3 V 最大工作温度:+ 90 C 最小工作温度:0 C 封装 / 箱体:TQFP-100 |
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