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参数资料
| 型号： | LC5256MC-75F256I |
| 厂商： | LATTICE SEMICONDUCTOR CORP |
| 元件分类： | PLD |
| 中文描述： | EE PLD, 9.5 ns, PBGA256 |
| 封装： | FPBGA-256 |
| 文件页数： | 31/95页 |
| 文件大小： | 923K |
| 代理商： | LC5256MC-75F256I |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页当前第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页
Lattice Semiconductor
ispXPLD 5000MX Family Data Sheet
37
tSPADDH
Address Hold time
after Clock Time
—
-0.01
—
-0.01
—
-0.01
—
-0.01
—
-0.01
—
ns
tSPRWS
R/W Setup before
Clock Time
—
-0.27
—
-0.27
—
-0.27
—
-0.27
—
-0.21
—
ns
tSPRWH
R/W Hold time after
Clock Time
—
-0.01
—
-0.01
—
-0.01
—
-0.01
—
-0.01
—
ns
tSPDATAS
Data Setup before
Clock Time
—
-0.27
—
-0.27
—
-0.27
—
-0.27
—
-0.21
—
ns
tSPDATAH
Data Hold time after
Clock Time
—
-0.01
—
-0.01
—
-0.01
—
-0.01
—
-0.01
—
ns
tSPCLKO
Clock to Output
Delay
—
5.97
—
5.97
—
5.97
—
5.97
—
9.86
ns
tSPRSTO
Reset to RAM
Output Delay
—
3.30
—
3.30
—
3.30
—
3.30
—
4.29
ns
tSPRSTR
Reset Recovery
Time
—
1.20
—
1.20
—
1.20
—
1.20
—
1.56
—
ns
tSPRSTPW
Reset Pulse Width
—
0.14
—
0.14
—
0.14
—
0.14
—
0.19
—
ns
Pseudo Dual Port RAM
tPDPMSS
Memory Select
Setup Before Clock
—
-0.27
—
-0.27
—
-0.22
—
-0.22
—
-0.21
—
ns
tPDPMSH
Memory Select
Hold time after
Clock
—
-0.01
—
-0.01
—
-0.01
—
-0.01
—
-0.01
—
ns
tPDPRCES
Clock Enable Setup
before Read Clock
Time
—
2.33
—
2.33
—
2.91
—
2.91
—
3.03
—
ns
tPDPRCEH
Clock Enable Hold
time after Read
Clock Time
—
-2.95
—
-2.95
—
-2.36
—
-2.36
—
-2.27
—
ns
tPDPWCES
Clock Enable Setup
before Write Clock
Time
—
1.87
—
1.87
—
2.34
—
2.34
—
2.43
—
ns
tPDPWCEH
Clock Enable Hold
time after Write
Clock Time
—
-2.95
—
-2.95
—
-2.36
—
-2.36
—
-2.27
—
ns
tPDPRADDS
Read Address
Setup before Read
Clock Time
—
-0.27
—
-0.27
—
-0.22
—
-0.22
—
-0.21
—
ns
tPDPRADDH
Read Address Hold
after Read Clock
Time
—
-0.01
—
-0.01
—
-0.01
—
-0.01
—
-0.01
—
ns
tPDPWADDS
Write Address
Setup before Write
Clock Time
—
-0.27
—
-0.27
—
-0.22
—
-0.22
—
-0.21
—
ns
tPDPWADDH
Write Address Hold
after Write Clock
Time
—
-0.01
—
-0.01
—
-0.01
—
-0.01
—
-0.01
—
ns
tPDPRWS
R/W Setup before
Clock Time
—
-0.27
—
-0.27
—
-0.22
—
-0.22
—
-0.21
—
ns
ispXPLD 5000MX Family Internal Switching Characteristics (Continued)
Over Recommended Operating Conditions
Parameter
Description
Base
Parameter
-4
-45
-5
-52
-75
Units
Min.
Max.
Min.
Max.
Min.
Max.
Min.
Max.
Min.
Max.
相关PDF资料 |
PDF描述 |
|---|---|
| LC51024MC-52F672C | |
| LC51024MB-75F672I | |
| LC6554H | 4-BIT, MROM, 4.33 MHz, MICROCONTROLLER, PDIP64 |
| LC864508 | 8-BIT, MROM, 12.24 MHz, MICROCONTROLLER, PDIP52 |
| LC868016A | 8-BIT, MROM, 12.24 MHz, MICROCONTROLLER, UUC138 |
相关代理商/技术参数 |
参数描述 |
|---|---|
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| LC5256MC-75F484I | 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:3.3V, 2.5V and 1.8V In-System Programmable eXpanded Programmable Logic Device XPLD⑩ Family |
| LC5256MC-75F672C | 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:3.3V, 2.5V and 1.8V In-System Programmable eXpanded Programmable Logic Device XPLD⑩ Family |
| LC5256MC-75F672I | 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:3.3V, 2.5V and 1.8V In-System Programmable eXpanded Programmable Logic Device XPLD⑩ Family |
| LC5256MC-75FN208C | 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:3.3V, 2.5V and 1.8V In-System Programmable eXpanded Programmable Logic Device XPLD⑩ Family |
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