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参数资料
| 型号： | LC5768MV-5FN256C |
| 厂商： | Lattice Semiconductor Corporation |
| 文件页数： | 89/99页 |
| 文件大小： | 0K |
| 描述： | IC CPLD 512MACROCELLS 256FPBGA |
| 标准包装： | 90 |
| 系列： | ispXPLD® 5000MV |
| 可编程类型： | 系统内可编程 |
| 最大延迟时间 tpd(1)： | 5.0ns |
| 电压电源 - 内部： | 3 V ~ 3.6 V |
| 逻辑元件/逻辑块数目： | 24 |
| 宏单元数： | 768 |
| 输入/输出数： | 193 |
| 工作温度： | 0°C ~ 90°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 256-BGA |
| 供应商设备封装： | 256-FPBGA（17x17） |
| 包装： | 托盘 |
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Lattice Semiconductor
ispXPLD 5000MX Family Data Sheet
5
Figure 3. MFB in SuperWIDE Logic Mode
Figure 4. Macrocell Slice in Logic Mode AND-Array
To Routing
Reset
CLK0
CLK3
CLK1
CLK2
PTOE
Sharing
To
I/O
via
OSA
Carry
In
Carry Out
68 Inputs
from
Routing
68 Inputs
from
Adjacent
MFB
AND
Array
68
inputs
164
P-Term
Dual-OR
Gate
PT
Sharing
Array
Shared PT Reset
Shared PT Clk
32
Macrocells
32
Macrocell
Feedback
Signals
Shared PT Clk En
From
GRP
68
PTSA
From
n-7
Carry-in
To
n+7
PTSA Bypass
PT OE to
I/O Block
From
I/O Cell
PT Clock
PT Preset
PT Reset
Shared PT Reset
Shared
PT CE
CLK0
Shared PTCLK
CLK1
CLK2
CLK3
Global Reset
Clk En
Clk
R/L
D
PR
Q
AND Array
Dual-OR Array
Macrocell
Output
to I/O Block or
Internal Control
(See Pin Table
for Assignments)
GRP
Carry-out
SELECT
DEVICES
DISCONTINUED
相关PDF资料 |
PDF描述 |
|---|---|
| PSAA15W-050 | ADAPTER DESKTOP CLASS II 15W 5V |
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| TAJR156K004RNJ | CAP TANT 15UF 4V 10% 0805 |
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相关代理商/技术参数 |
参数描述 |
|---|---|
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| LC5768MV-5FN484I | 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:3.3V, 2.5V and 1.8V In-System Programmable eXpanded Programmable Logic Device XPLD⑩ Family |
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