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参数资料
| 型号： | LC5768VG-12F484I |
| 厂商： | LATTICE SEMICONDUCTOR CORP |
| 元件分类： | PLD |
| 中文描述： | EE PLD, 12 ns, PBGA484 |
| 封装： | FBGA-484 |
| 文件页数： | 1/48页 |
| 文件大小： | 237K |
| 代理商： | LC5768VG-12F484I |
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www.latticesemi.com
1
5kvg_09
ispMACH 5000VG Family
3.3V In-System Programmable
SuperBIG, SuperWIDE High Density PLDs
December 2001
Data Sheet
TM
Features
■ High Density
768 to 1,024 macrocells
196 to 384 I/Os
■ sysCLOCK PLL – Timing Control
Multiply and divide factors between 1 and 32
Clock shifting capability ± 3.5ns in 500ps steps
Multiple output frequencies
External feedback capability for board-level
clock deskew
LVDS/LVPECL clock input capability
■ High Speed Logic Implementation
SuperWIDE 68-input logic block
Up to 160 product terms per output
Hierarchical routing structure provides fast inter-
connect
■ sysIO Capability
LVCMOS 1.8, 2.5 and 3.3
LVTTL
SSTL 2 (I & II)
SSTL 3 (I & II)
CTT 3.3, CTT 2.5
HSTL (I & III)
PCI-X, PCI 3.3
GTL+
AGP-1X
5V tolerance
Programmable drive strength
■ Ease of Design
Product term sharing
Extensive clocking and OE capability
■ Easy System Integration
3.3V power supply
Hot socketing
Input pull-up, pull-down or bus-keeper
Open drain capability
Slew rate control
Macrocell-based power management
IEEE 1149.1 boundary scan testable
In-system programmable via IEEE 1532 ISC
compliant interface
ispMACH 5000VG Introduction
The ispMACH 5000VG represents the third generation
of Lattice’s SuperWIDE CPLD architecture. Through
their wide 68-input blocks, these devices give signi-
cantly improved speed performance for typical designs
over architectures with fewer inputs.
The ispMACH 5000VG takes the unique benets of the
SuperWIDE architecture and extends it to higher densi-
ties referred to as SuperBIG, by using the combination
of an innovative product term architecture and a two-
tiered hierarchical routing architecture. Additionally,
sysCLOCK and sysIO capabilities have been added to
maximize system-level performance and integration.
Table 1. ispMACH 5000VG Family Selection Guide
ispMACH
5768VG
ispMACH
51024VG
Macrocells
768
1,024
User I/O Options
196/304
304/384
tPD (ns)
5.0
tS – Set-up with 0 Hold (ns)
3.0
tCO (ns)
4.4
fMAX (MHz)
178
Supply Voltage (V)
3.3V
Package
256-ball fpBGA
484-ball fpBGA
676-ball fpBGA
相关PDF资料 |
PDF描述 |
|---|---|
| LC5768VG-12F256I | |
| LC5512B-75F256C | |
| LC5256B-75T128I | |
| LC5384B-10F256I | |
| LC5512B-45F256C | |
相关代理商/技术参数 |
参数描述 |
|---|---|
| LC5768VG-5F256C | 功能描述:CPLD - 复杂可编程逻辑器件 PROGRAM EXPANDED LOG RoHS:否 制造商:Lattice 系列: 存储类型:EEPROM 大电池数量:128 最大工作频率:333 MHz 延迟时间:2.7 ns 可编程输入/输出端数量:64 工作电源电压:3.3 V 最大工作温度:+ 90 C 最小工作温度:0 C 封装 / 箱体:TQFP-100 |
| LC5768VG-5F484C | 功能描述:CPLD - 复杂可编程逻辑器件 PROGRAM EXPANDED LOG RoHS:否 制造商:Lattice 系列: 存储类型:EEPROM 大电池数量:128 最大工作频率:333 MHz 延迟时间:2.7 ns 可编程输入/输出端数量:64 工作电源电压:3.3 V 最大工作温度:+ 90 C 最小工作温度:0 C 封装 / 箱体:TQFP-100 |
| LC5768VG-5FN484C | 制造商:Lattice Semiconductor Corporation 功能描述:CPLD ispMACH 5000VG Family 768 Macro Cells 178.6MHz 3.3V 484-Pin FBGA |
| LC5768VG-75F256C | 功能描述:CPLD - 复杂可编程逻辑器件 PROGRAM EXPANDED LOG RoHS:否 制造商:Lattice 系列: 存储类型:EEPROM 大电池数量:128 最大工作频率:333 MHz 延迟时间:2.7 ns 可编程输入/输出端数量:64 工作电源电压:3.3 V 最大工作温度:+ 90 C 最小工作温度:0 C 封装 / 箱体:TQFP-100 |
| LC5768VG-75F256I | 功能描述:CPLD - 复杂可编程逻辑器件 PROGRAM EXPANDED LOG RoHS:否 制造商:Lattice 系列: 存储类型:EEPROM 大电池数量:128 最大工作频率:333 MHz 延迟时间:2.7 ns 可编程输入/输出端数量:64 工作电源电压:3.3 V 最大工作温度:+ 90 C 最小工作温度:0 C 封装 / 箱体:TQFP-100 |
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