参数资料
| 型号： | LC75812PT-8565-H |
| 厂商： | ON Semiconductor |
| 文件页数： | 3/54页 |
| 文件大小： | 0K |
| 描述： | IC LCD DISPLAY DRIVER 100TQFP |
| 标准包装： | 90 |
| 系列： | * |
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LC75812PT
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Parameter
Input high level voltage
Symbol
VIH1
VIH2
VIH3
Conditions
CE, CL, DI, INH
CE, CL, DI, INH
VDD=2.7 to 3.6V
OSC external clock operating mode
KI1 to KI5
min
0.8VDD
0.8VDD
0.8VDD
0.6VDD
Ratings
typ
max
3.6
5.5
VDD
VDD
unit
V
Input low level voltage
Output pull-up voltage
Recommended external
resistor for RC oscillation
Recommended external
capacitor for RC oscillation
VIL1
VIL2
VOUP
Rosc
Cosc
CE, CL, DI, INH, KI1 to KI5
OSC external clock operating mode
DO
OSC RC oscillator operating mode
OSC RC oscillator operating mode
0
0
0
10
470
0.2VDD
0.2VDD
5.5
V
V
k Ω
pF
Guaranteed range of RC
oscillation
fosc
OSC RC oscillator operating mode
150
300
600
kHz
External clock operating frequency
External clock duty cycle
fCK
DCK
OSC external clock operating mode
OSC external clock operating mode
[Figure 4]
[Figure 4]
100
30
300
50
600
70
kHz
%
Data setup time
Data hold time
CE wait time
CE setup time
CE hold time
High level clock pulse width
Low level clock pulse width
DO output delay time
DO rise time
tds
tdh
tcp
tcs
tch
t φ H
t φ L
tdc
tdr
CL, DI
CL, DI
CE, CL
CE, CL
CE, CL
CL
CL
DO RPU=4.7k Ω CL=10pF *1
DO RPU=4.7k Ω CL=10pF *1
[Figure 2],[Figure 3]
[Figure 2],[Figure 3]
[Figure 2],[Figure 3]
[Figure 2],[Figure 3]
[Figure 2],[Figure 3]
[Figure 2],[Figure 3]
[Figure 2],[Figure 3]
[Figure 2],[Figure 3]
[Figure 2],[Figure 3]
160
160
160
160
160
160
160
1.5
1.5
ns
ns
ns
ns
ns
ns
ns
μ s
μ s
Note: * 1. Since the DO pin is an open-drain output, these times depend on the values of the pull-up resistor RPU and
the load capacitance CL.
Electrical Characteristics for the Allowable Operating Ranges
Parameter
Symbol
Pins
Conditions
Ratings
unit
min
typ
max
Hysteresis
VH
CE, CL, DI, INH,
KI1 to KI5
0.1VDD
V
Power-down detection
voltage
Input high level current
VDET
IIH1
CE, CL, DI, INH
VI=3.6V
2.0
2.2
2.4
5.0
V
VI=5.5V
VDD=2.7 to 3.6V
5.0
μ A
IIH2
OSC
VI=VDD external clock operating mode
5.0
Input low level current
Input floating voltage
IIL1
IIL2
VIF
CE, CL, DI, INH
OSC
KI1 to KI5
VI=0V
VI=0V external clock operating mode
-5.0
-5.0
0.05VDD
μ A
V
Pull-down resistance
Output off leakage current
RPD
IOFFH
KI1 to KI5
DO
VDD=3.3V
VO=5.5V
50
100
250
6.0
k Ω
μ A
Output high level voltage
VOH1
S1 to S65
IO=-20 μ A
VLCD0-0.6
VOH2
VOH3
COM1 to COM9
KS1 to KS7
IO=-100 μ A
IO=-250 μ A
VLCD0-0.6
VDD-0.8
VDD-0.4
VDD-0.1
V
VOH4
P1 to P3
IO=-1mA
VDD-0.9
Output low level voltage
VOL1
VOL2
S1 to S65
COM1 to COM9
IO=20 μ A
IO=100 μ A
VLCD4+0.6
VLCD4+0.6
VOL3
KS1 to KS7
IO=12.5 μ A
0.1
0.4
1.2
V
VOL4
P1 to P3
IO=1mA
0.9
VOL5
DO
IO=1mA
0.1
0.3
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No.A1417-3/54
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PDF描述 |
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