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参数资料
| 型号： | LFEC15E-3F484C |
| 厂商： | Lattice Semiconductor Corporation |
| 文件页数： | 130/163页 |
| 文件大小： | 0K |
| 描述： | IC FPGA 10.2KLUTS 288I/O 484-BGA |
| 标准包装： | 60 |
| 系列： | EC |
| 逻辑元件/单元数： | 15400 |
| RAM 位总计： | 358400 |
| 输入/输出数： | 352 |
| 电源电压： | 1.14 V ~ 1.26 V |
| 安装类型： | 表面贴装 |
| 工作温度： | 0°C ~ 85°C |
| 封装/外壳： | 484-BBGA |
| 供应商设备封装： | 484-FPBGA（23x23） |
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4-3
Pinout Information
LatticeECP/EC Family Data Sheet
PICs and DDR Data (DQ) Pins Associated with the DDR Strobe (DQS) Pin
PICs Associated
with DQS Strobe
PIO Within PIC
DDR Strobe (DQS) and
Data (DQ) Pins
P[Edge] [n-4]
ADQ
BDQ
P[Edge] [n-3]
ADQ
BDQ
P[Edge] [n-2]
ADQ
BDQ
P[Edge] [n-1]
ADQ
BDQ
P[Edge] [n]
A[Edge]DQSn
BDQ
P[Edge] [n+1]
ADQ
BDQ
P[Edge] [n+2]
ADQ
BDQ
P[Edge] [n+3]
ADQ
BDQ
Notes:
1. “n” is a Row/Column PIC number
2. The DDR interface is designed for memories that support one DQS strobe per eight bits of
data. In some packages, all the potential DDR data (DQ) pins may not be available.
3. PIC numbering definitions are provided in the “Signal Names” column of the Signal Descrip-
tions table.
相关PDF资料 |
PDF描述 |
|---|---|
| LT1764AEQ#TR | IC REG LDO ADJ 3A DDPAK-5 |
| LT3015IQ-3#PBF | IC REG LDO -3V 1.5A DDPAK-5 |
| LT3015IQ-2.5#PBF | IC REG LDO -2.5V 1.5A DDPAK-5 |
| LFEC10E-4QN208C | IC FPGA 10.2KLUTS 208PQFP |
| LT3015IQ-15#PBF | IC REG LDO -15V 1.5A DDPAK-5 |
相关代理商/技术参数 |
参数描述 |
|---|---|
| LFEC15E-3F484I | 功能描述:FPGA - 现场可编程门阵列 15.4K LUTs 352 I/O RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256 |
| LFEC15E-3F672C | 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:LatticeECP/EC Family Data Sheet |
| LFEC15E-3F672I | 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:LatticeECP/EC Family Data Sheet |
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| LFEC15E-3F900I | 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:LatticeECP/EC Family Data Sheet |
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