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参数资料
| 型号： | LTC1174HVIS8#PBF |
| 厂商： | Linear Technology |
| 文件页数： | 11/20页 |
| 文件大小： | 0K |
| 描述： | IC REG BUCK INV ADJ 1A 8SOIC |
| 标准包装： | 100 |
| 类型： | 降压（降压），反相 |
| 输出类型： | 可调式 |
| 输出数： | 1 |
| 输出电压： | 1.25 V ~ 18 V |
| 输入电压： | 4 V ~ 18.5 V |
| PWM 型： | 电流模式，混合 |
| 频率 - 开关： | 200kHz |
| 电流 - 输出： | 1A |
| 同步整流器： | 无 |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 8-SOIC（0.154"，3.90mm 宽） |
| 包装： | 管件 |
| 供应商设备封装： | 8-SOIC |
LTC1174
LTC1174-3.3/LTC1174-5
APPLICATIO S I FOR ATIO
= PEAK
Board Layout Checklist
When laying out the printed circuit board, the following
checklist should be used to ensure proper operation of the
LTC1174. These items are also illustrated graphically in
the layout diagram in Figure 7. Check the following in your
layout:
1. Is the Schottky catch diode closely connected between
ground (Pin 4) and switch (Pin 5)?
2. Is the “+” plate of C IN closely connected to V IN (Pin 6)?
This capacitor provides the AC current to the internal
P-channel MOSFET.
DESIGN EXAMPLE
As a design example, assume V IN = 9V (nominal), V OUT =
5V, and I OUT = 350mA maximum. The LTC1174-5 is used
for this application, with I PGM (Pin 7) connected to V IN . The
minmum value of L is determined by assuming the
LTC1174-5 is operating in continuous mode.
I PEAK
AVG CURRENT = I OUT
I + I V
I V 2
= 350mA
3. Is the 0.1 μ F V IN decoupling capacitor closely conected
between V IN (Pin 6) and ground (Pin 4)? This capacitor
TIME
1174 F08
carries the high frequency peak currents.
4. Is the SHUTDOWN (Pin 8) actively pulled to V IN during
normal operation? The SHUTDOWN pin is high imped-
ance and must not be allowed to float.
Figure 8. Continuous Inductor Current
With I OUT = 350mA and I PEAK = 0.6A (I PGM = V IN ), I V =
0.1A.The peak-to-peak ripple inductor current, I RIPPLE , is
0.5A and is also equal to:
I RIPPLE = 4 ? 10 ? 6 ? OUT D ?
5. Is the I PGM (Pin 7) pulled either to V IN or ground? The
I PGM pin is high impedance and must not be allowed
to float.
? L ?
? V + V ?
( A P ? P )
(V FB )
OUTPUT DIVIDER
1 V OUT
2
LB OUT
SHUTDOWN
I PGM
8
7
REQUIRED WITH
ADJUSTABLE
VERSION ONLY
R2
R1
3
4
LB IN
GND
LTC1174
V IN
SW
6
5
0.1 μ F
+
C IN
V IN
BOLD LINES INDICATE
HIGH CURRENT PATH
D
C OUT
L
V OUT
1174 F07
Figure 7. LTC1174 Layout Diagram (See Board Layout Checklist)
1174fe
11
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