参数资料
型号: LTC1409ISW#PBF
厂商: Linear Technology
文件页数: 18/20页
文件大小: 0K
描述: IC A/D CONV 12BIT SAMPLNG 28SOIC
标准包装: 27
位数: 12
采样率(每秒): 800k
数据接口: 并联
转换器数目: 1
功率耗散(最大): 120mW
电压电源: 双 ±
工作温度: -40°C ~ 85°C
安装类型: 表面贴装
封装/外壳: 28-SOIC(0.295",7.50mm 宽)
供应商设备封装: 28-SOIC
包装: 管件
输入数目和类型: 2 个单端,双极;1 个差分,双极
7
LTC1409
PI FU CTIO S
UU
U
CONVST (Pin 23): Conversion Start Signal. This active
low signal starts a conversion on its falling edge.
CS (Pin 24): Chip Select. The input must be low for the
ADC to recognize CONVST and RD inputs.
BUSY (Pin 25): The BUSY output shows the converter
status. It is low when a conversion is in progress. Data
valid on the rising edge of BUSY.
VSS (Pin 26): – 5V Negative Supply. Bypass to AGND
using 10
F tantalum in parallel 0.1F or 10F ceramic.
OVDD (Pin 27): Positive Supply for Output Drivers. For
5V logic, short to Pin 28. For 3V logic, short to supply
of the logic being driven.
AVDD (Pin 28): 5V Positive Supply. Bypass to AGND
10
F tantalum in parallel with 0.1F or 10F ceramic.
Load Circuits for Bus Relinquish Time
Load Circuits for Access Timing
1k
100pF
DBN
1k
5V
LTC1409 TC02
1k
CL
DBN
1k
5V
LTC1409 TC01
(a) Hi-Z to VOH
and VOL to VOH
(b) Hi-Z to VOL
and VOH to VOL
(a) VOH to Hi-Z
(b) VOL to Hi-Z
FU CTIO AL BLOCK DIAGRA
UU
W
12-BIT CAPACITIVE DAC
COMP
REF AMP
2.5V REF
4k
REFCOMP
(4.06V)
CSAMPLE
D11
D0
BUSY
CONTROL LOGIC
CS
CONVST
RD
SHDN
INTERNAL
CLOCK
NAP/SLP
ZEROING SWITCHES
OVDD
OGND
AVDD
+AIN
–AIN
VREF
AGND
DGND
12
LTC1409 BD
+
SUCCESSIVE APPROXIMATION
REGISTER
OUTPUT LATCHES
TEST CIRCUITS
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LTC1409ISW IC A/D CONV 12BIT SAMPLNG 28SOIC
LTC1410ISW#PBF IC A/D CONV 12BIT SAMPLNG 28SOIC
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参数描述
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