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参数资料
| 型号： | LTC1450LCG#TR |
| 厂商： | Linear Technology |
| 文件页数： | 15/16页 |
| 文件大小： | 0K |
| 描述： | IC DAC 12BIT R-R PAR MPWR 24SSOP |
| 标准包装： | 1,800 |
| 设置时间： | 14µs |
| 位数： | 12 |
| 数据接口： | 并联 |
| 转换器数目： | 1 |
| 电压电源： | 单电源 |
| 功率耗散（最大）： | 750µW |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 24-SSOP（0.209"，5.30mm 宽） |
| 供应商设备封装： | 24-SSOP |
| 包装： | 带卷 (TR) |
| 输出数目和类型： | 1 电压，单极；1 电压，双极 |
| 采样率（每秒）： | * |
8
LTC1450/LTC1450L
DIGITAL INTERFACE TRUTH TABLE
U
CLR
CSMSB
CSLSB
WR
LDAC
FUNCTION
H
L
H
Loads the eight LSBs into the input latch
HH
L
↑
H
Latches the eight LSBs into the input latch
HH
↑
L
H
Latches the eight LSBs into the input latch
H
L
H
L
H
Loads the four MSBs into the input latch
HL
H
↑
H
Latches the four MSBs into the input latch
H
↑
H
L
H
Latches the four MSBs into the input latch
H
L
Loads the input latch data into the DAC latch
H
HHH
↑
Latches the input latch data into the DAC latch
H
L
Loads input data into DAC latches (latches transparent)
HL
L
↑
Latches input data into DAC latches
L
X
All zeros loaded into input and DAC latches
TIMING DIAGRAM
W
U
W
BLOCK DIAGRAM
W
CSMSB
WR
LDAC
LTC1450/50L TD01
tCS
CSLSB
DATA
t CS
t WR
tWR
tCWS
tCWH
tDWS
t LDAC
DAC UPDATE
tDWH
DATA VALID
–
+
REFERENCE
LTC1450: 2.048V
LTC1450L: 1.22V
DAC
12-BIT DAC LATCH
D11
(MSB) D10 D9
D8
D6
D4
D2
D0
(LSB)
D7
D5
D3
D1
UPPER 4-BIT
INPUT LATCH
POWER-ON
RESET
LOWER 8-BIT
INPUT LATCH
LDAC
CLR
CSMSB
WR
CSLSB
REFOUT
VCC
20
19
18
17
22
21
16
4
5
6
7
8
9
10
11
12
13
14
15
24
23
3
1
2
REFHI
REFLO
X1/X 2
VOUT
GND
LTC1450/50L BD
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PDF描述 |
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