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参数资料
型号： LTC1458CSW#PBF
厂商： Linear Technology
文件页数： 6/12页
文件大小： 0K
描述： IC D/A CONV 12BIT R-R QUAD28SOIC
标准包装： 27
设置时间： 14µs
位数： 12
数据接口： 串行
转换器数目： 4
电压电源： 单电源
功率耗散（最大）： 5.5mW
工作温度： 0°C ~ 70°C
安装类型： 表面贴装
封装/外壳： 28-SOIC（0.295"，7.50mm 宽）
供应商设备封装： 28-SOIC
包装： 管件
输出数目和类型： 4 电压，单极
采样率（每秒）： *
产品目录页面： 1350 (CN2011-ZH PDF)
3
LTC1458/LTC1458L
ELECTRICAL CHARACTERISTICS The q denotes the specifications which apply over the full operating
temperature range, otherwise specifications are at TA = TMIN to TMAX. VCC = 4.5V to 5.5V (LTC1458), 2.7V to 5.5V (LTC1458L),
X1/X2 = REFLO = GND, REFHI = REFOUT, VOUT unloaded, unless otherwise noted.
SYMBOL
PARAMETER
CONDITIONS
MIN
TYP
MAX
UNITS
Reference Input Capacitance
15
pF
Short-Circuit Current
REFOUT Shorted to GND
q
45
120
mA
Power Supply
VCC
Positive Supply Voltage
For Specified Performance, LTC1458
q
4.5
5.5
V
LTC1458L
q
2.7
5.5
V
ICC
Supply Current
4.5V
≤ VCC ≤ 5.5V (Note 5) , LTC1458
q
1100
2400
A
2.7V
≤ VCC ≤ 5.5V (Note 5), LTC1458L
q
800
2000
A
Op Amp DC Performance
Short-Circuit Current Low
VOUT Shorted to GND
q
60
120
mA
Short-Circuit Current High
VOUT Shorted to VCC
q
70
120
mA
Output Impedance to GND
Input Code = 0
q
40
160
AC Performance
Voltage Output Slew Rate
(Note 3)
q
0.5
1.0
V/
s
Voltage Output Settling Time
(Notes 3, 4) to
±0.5LSB
14
s
Digital Feedthrough
0.3
nV s
AC Feedthrough
REFHI = 1kHz, 2VP-P, (Code: All 0s)
– 95
dB
SINAD
Signal-to-Noise + Distortion
REFHI = 1kHz, 2VP-P, (Code: All 1s)
85
dB
The q denotes the specifications which apply over the full operating temperature range, otherwise specifications are at
TA = TMIN to TMAX. VCC = 5V (LTC1458), 3V (LTC1458L), unless otherwise noted.
LTC1458
LTC1458L
SYMBOL
PARAMETER
CONDITIONS
MIN
TYP
MAX
MIN
TYP
MAX
UNITS
Digital I/O
VIH
Digital Input High Voltage
q
2.4
2.0
V
VIL
Digital Input Low Voltage
q
0.8
0.6
V
VOH
Digital Output High Voltage
IOUT = – 1mA
q
VCC – 1.0
VCC – 0.7
V
VOL
Digital Output Low Voltage
IOUT = 1mA
q
0.4
V
ILEAK
Digital Input Leakage
VIN = GND to VCC
q
±10
A
CIN
Digital Input Capacitance
Guaranteed by Design,
q
10
pF
Not Subject to Test
Switching
t1
DIN Valid to CLK Setup
q
40
60
ns
t2
DIN Valid to CLK Hold
q
00
ns
t3
CLK High Time
q
40
60
ns
t4
CLK Low Time
q
40
60
ns
t5
CS/LD Pulse Width
q
50
80
ns
t6
LSB CLK to CS/LD
q
40
60
ns
t7
CS/LD Low to CLK
q
20
30
ns
t8
DOUT Output Delay
CLOAD = 15pF
q
150
220
ns
t9
CLK Low to CS/LD Low
q
20
30
ns
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