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参数资料
| 型号： | LTC1522CS8 |
| 厂商： | Linear Technology |
| 文件页数： | 6/8页 |
| 文件大小： | 0K |
| 描述： | IC REG SWITCHED CAP 5V 8SOIC |
| 标准包装： | 100 |
| 类型： | 切换式电容器（充电泵） |
| 输出类型： | 固定 |
| 输出数： | 1 |
| 输出电压： | 5V |
| 输入电压： | 2.7 V ~ 5 V |
| 频率 - 开关： | 700kHz |
| 电流 - 输出： | 20mA |
| 同步整流器： | 无 |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 8-SOIC（0.154"，3.90mm 宽） |
| 包装： | 管件 |
| 供应商设备封装： | 8-SOIC |
LTC1522
APPLICATIO N S I N FOR M ATIO N
1
NC
NC
8
V IN
2.7V TO 5V
+
10 μ F
+
2
3
10 μ F 4
V IN
V OUT
C +
SHDN
LTC1522
GND
C –
0.22 μ F
7
6
5
FROM MPU
SHDN PIN WAVEFORMS:
LOW I Q MODE (2Hz TO 100Hz, 95% TO 98% DUTY CYCLE) V OUT LOAD ENABLE MODE
I OUT ≤ 100 μ A (I OUT = 100 μ A TO 20mA)
1522 F02
V OUT
5V ± 4%
Figure 2. Ultralow Quiescent Current (<2.1 μ A) Regulated Supply
6.0
4.0
2.0
0.0
1000
100
10
1
SHDN ON PULSE WIDTH = 200 μ s
C OUT = 10 μ F
2.0
3.0 4.0
INPUT VOLTAGE (V)
5.0
1522 F03a
1
10 100
OUTPUT CURRENT ( μ A)
1000
1522 F03b
Figure 3a. No-Load I CC vs Input Voltage for Circuit in Figure 3
The LTC1522 must be out of shutdown for a minimum
duration of 200 μ s to allow enough time to sense the output
and keep it in regulation. A 2Hz, 98% duty cycle signal will
keep V OUT in regulation under no-load conditions. As the
V OUT load current increases, the frequency with which the
part is taken out of shutdown must also be increased to
prevent V OUT from drooping below 4.8V during the OFF
phase (see Figure 3b). A 100Hz 98% duty cycle signal on
the SHDN pin ensures proper regulation with load currents
as high as 100 μ A. When load current greater than 100 μ A
is needed, the SHDN pin must be forced low as in normal
operation. The typical no-load supply current for this
circuit with V IN = 3V is only 2.1 μ A .
6
Figure 3b. Maximum SHDN OFF Time vs Output Load Current
for Ultralow I Q Operation
Each time the LTC1522 comes out of shutdown, the part
delivers a minimum of one clock cycle worth of charge to
the output. Under high V IN (> 3.3V) and/or low I OUT (< 10 μ A)
conditions, this behavior may cause a net excess of charge
to be delivered to the output capacitor if a high frequency
signal is used on the SHDN pin (e.g., 50Hz to 100Hz).
Under such conditions, V OUT will slowly drift positive and
may even go out of regulation. To avoid this potential
problem in the low I Q mode, it is necessary to switch the
part in and out of shutdown at the minimum allowable
frequency (refer to Figure 3b) for a given output load.
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PDF描述 |
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参数描述 |
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