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参数资料
| 型号： | LTC1609ISW#TR |
| 厂商： | Linear Technology |
| 文件页数： | 10/24页 |
| 文件大小： | 0K |
| 描述： | IC A/DCONV 16BIT SRL SAMP 20SOIC |
| 标准包装： | 1,000 |
| 位数： | 16 |
| 采样率（每秒）： | 200k |
| 数据接口： | 串行 |
| 转换器数目： | 1 |
| 功率耗散（最大）： | 100mW |
| 电压电源： | 模拟和数字 |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 20-SOIC（0.295"，7.50mm 宽） |
| 供应商设备封装： | 20-SOIC |
| 包装： | 带卷 (TR) |
| 输入数目和类型： | 3 个单端，单极；3 个单端，双极 |
| 其它名称： | LTC1609ISWTR |
18
LTC1609
1609fa
TAG0
TAG
DATA
SYNC
BUSY
R/C
CS
TAG1
TAG2
TAG3
TAG15
B1
B14
B13
B15
(MSB)
B0
TAG0
TAG1
TAG16
TAG17
TAG18
TAG19
1606 F12
t23
t24
t17
t18
t3
t2
t16
t15
t12
0
1
2
3
4
16
17
18
EXTERNAL
DATACLK
t13
t14
t12
t19
Figure 12. Conversion and Read Timing Using an External Data Clock (EXT/INT Tied High).
Read Previous Conversion Result During the Conversion. For Best Performance, Complete Read in Less Than 1.2
s
APPLICATIO S I FOR ATIO
WU
UU
DATA
CS
R/C
DCLK
DCLK IN
R/C IN
CS IN
TAG
LTC1609
#2
DATA
CS
R/C
DCLK
TAG
DATA OUT
1609 F13
LTC1609
#1
Figure 13. Two LTC1609s Cascaded
Together Using the TAG Input
bit will be shifted out on the following clock pulse before
the MSB from device #2 becomes available (Figure 14).
The reason for this is the MSB from device #2 will not be
valid soon enough to meet the minimum setup time of
device #1’s TAG input. A minimum of 34 clock pulses are
needed to shift out the results from both LTC1609s
assuming the data is captured on the falling clock edge.
Using the highest frequency permitted for DATACLK
(20MHz), a 200kHz throughput can still be achieved.
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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| LTC1622CMS8#TR | 功能描述:IC REG CTRLR BUCK PWM CM 8-MSOP RoHS:否 类别:集成电路 (IC) >> PMIC - 稳压器 - DC DC 切换控制器 系列:- 标准包装:2,500 系列:- PWM 型:电流模式 输出数:1 频率 - 最大:500kHz 占空比:96% 电源电压:4 V ~ 36 V 降压:无 升压:是 回扫:无 反相:无 倍增器:无 除法器:无 Cuk:无 隔离:无 工作温度:-40°C ~ 125°C 封装/外壳:24-WQFN 裸露焊盘 包装:带卷 (TR) |
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