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参数资料
| 型号： | LTC1743IFW#PBF |
| 厂商： | Linear Technology |
| 文件页数： | 9/24页 |
| 文件大小： | 0K |
| 描述： | IC ADC 12BIT 50MSPS SMPL 48TSSOP |
| 标准包装： | 39 |
| 位数： | 12 |
| 采样率（每秒）： | 50M |
| 数据接口： | 并联 |
| 转换器数目： | 1 |
| 功率耗散（最大）： | 1.2W |
| 电压电源： | 单电源 |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 48-TFSOP（0.240"，6.10mm 宽） |
| 供应商设备封装： | 48-TSSOP |
| 包装： | 管件 |
| 输入数目和类型： | 2 个单端，双极；1 个差分，双极 |
17
LTC1743
1743f
APPLICATIO S I FOR ATIO
WU
U
Any noise present on the encode signal will result in
additional aperture jitter that will be RMS summed with the
inherent ADC aperture jitter.
In applications where jitter is critical (high input frequen-
cies) take the following into consideration:
1. Differential drive should be used.
2. Use as large an amplitude as possible; if transformer
coupled use a higher turns ratio to increase the
amplitude.
VDD
LTC1743
1743 F07
BIAS
VDD
5V
ENC
ANALOG INPUT
2V BIAS
1:4
0.1
F
CLOCK
INPUT
50
6k
TO INTERNAL
ADC CIRCUITS
3. If the ADC is clocked with a sinusoidal signal, filter the
encode signal to reduce wideband noise.
4. Balance the capacitance and series resistance at both
encode inputs so that any coupled noise will appear at
both inputs as common mode noise.
The encode inputs have a common mode range of 1.8V to
VDD. Each input may be driven from ground to VDD for
single-ended drive.
Figure 7. Transformer Driven ENC/ENC with Equivalent Encode Input Circuit
1743 F08a
ENC
2V
VTHRESHOLD = 2V
ENC
0.1
F
LTC1743
1743 F08b
ENC
130
3.3V
130
D0
Q0
MC100LVELT22
LTC1743
83
83
Figure 8a. Single-Ended ENC Drive,
Not Recommended for Low Jitter
Figure 8b. ENC Drive Using a CMOS-to-PECL Translator
相关PDF资料 |
PDF描述 |
|---|---|
| LTC1744IFW#TRPBF | IC ADC 14BIT 50MSPS 48-TSSOP |
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| LTC1746IFW#TRPBF | IC ADC 14BIT 25MSPS LP 48TSSOP |
| LTC1747IFW#PBF | IC ADC 12BIT 80MSPS 48-TSSOP |
| LTC1748CFW#TRPBF | IC ADC 14BIT 80MSPS 48-TSSOP |
相关代理商/技术参数 |
参数描述 |
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