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参数资料
| 型号： | LTC2221CUP#TRPBF |
| 厂商： | Linear Technology |
| 文件页数： | 28/32页 |
| 文件大小： | 0K |
| 描述： | IC ADC 12-BIT 135MSPS 64-QFN |
| 标准包装： | 2,000 |
| 位数： | 12 |
| 采样率（每秒）： | 135M |
| 数据接口： | 并联 |
| 转换器数目： | 1 |
| 功率耗散（最大）： | 931mW |
| 电压电源： | 单电源 |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 64-WFQFN 裸露焊盘 |
| 供应商设备封装： | 64-QFN（9x9） |
| 包装： | 带卷 (TR) |
| 输入数目和类型： | 1 个单端，双极; 1 个差分，双极 |
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LTC2220/LTC2221
5
22201fa
TI I G CHARACTERISTICS
U
W
The
● denotes the specifications which apply over the full operating temperature
range, otherwise specifications are at TA = 25°C. (Note 4)
POWER REQUIRE E TS
W
U
The
● denotes the specifications which apply over the full operating temperature
range, otherwise specifications are at TA = 25°C. (Note 9)
LTC2220
LTC2221
SYMBOL
PARAMETER
CONDITIONS
MIN
TYP
MAX
MIN
TYP
MAX
UNITS
VDD
Analog Supply Voltage
(Note 8)
●
3.1
3.3
3.5
3.1
3.3
3.5
V
PSHDN
Shutdown Power
SHDN = High, OE = High, No CLK
2
mW
PNAP
Nap Mode Power
SHDN = High, OE = Low, No CLK
35
mW
LVDS OUTPUT MODE
OVDD
Output Supply Voltage
(Note 8)
●
3
3.3
3.6
3
3.3
3.6
V
IVDD
Analog Supply Current
●
264
288
196
212
mA
IOVDD
Output Supply Current
●
55
70
55
70
mA
PDISS
Power Dissipation
●
1050
1182
828
931
mW
CMOS OUTPUT MODE
OVDD
Output Supply Voltage
(Note 8)
●
0.5
3.3
3.6
0.5
3.3
3.6
V
IVDD
Analog Supply Current
●
264
288
196
212
mA
PDISS
Power Dissipation
890
660
mW
LTC2220
LTC2221
SYMBOL
PARAMETER
CONDITIONS
MIN
TYP
MAX
MIN
TYP
MAX
UNITS
fS
Sampling Frequency
(Note 8)
●
1
170
1
135
MHz
tL
ENC Low Time (Note 7)
Duty Cycle Stabilizer Off
●
2.8
2.94
500
3.5
3.7
500
ns
Duty Cycle Stabilizer On
●
2
2.94
500
2
3.7
500
ns
tH
ENC High Time (Note 7)
Duty Cycle Stabilizer Off
●
2.8
2.94
500
3.5
3.7
500
ns
Duty Cycle Stabilizer On
●
2
2.94
500
2
3.7
500
ns
tAP
Sample-and-Hold Aperture Delay
0
ns
tOE
Output Enable Delay
(Note 7)
●
510
ns
LVDS OUTPUT MODE
tD
ENC to DATA Delay
(Note 7)
●
1.3
2.2
3.5
1.3
2.2
3.5
ns
tC
ENC to CLOCKOUT Delay
(Note 7)
●
1.3
2.2
3.5
1.3
2.2
3.5
ns
DATA to CLOCKOUT Skew
(tC - tD) (Note 7)
●
–0.6
0
0.6
–0.6
0
0.6
ns
Rise Time
0.5
ns
Fall Time
0.5
ns
Pipeline Latency
5
Cycles
CMOS OUTPUT MODE
tD
ENC to DATA Delay
(Note 7)
●
1.3
2.1
3.5
1.3
2.1
3.5
ns
tC
ENC to CLOCKOUT Delay
(Note 7)
●
1.3
2.1
3.5
1.3
2.1
3.5
ns
DATA to CLOCKOUT Skew
(tC - tD) (Note 7)
●
–0.6
0
0.6
–0.6
0
0.6
ns
Pipeline Latency Full Rate CMOS
5
Cycles
Demuxed Interleaved
5
Cycles
Demuxed Simultaneous
5 and 6
Cycles
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