参数资料
型号: LTC2447IUHF#PBF
厂商: Linear Technology
文件页数: 2/28页
文件大小: 0K
描述: IC ADC 24BIT 8CH HI SPEED 38QFN
标准包装: 52
位数: 24
采样率(每秒): 8k
数据接口: MICROWIRE?,串行,SPI?
转换器数目: 1
功率耗散(最大): 40mW
电压电源: 单电源
工作温度: -40°C ~ 85°C
安装类型: 表面贴装
封装/外壳: 38-WFQFN 裸露焊盘
供应商设备封装: 38-QFN(5x7)
包装: 管件
输入数目和类型: 8 个单端,双极;4 个差分,双极
产品目录页面: 1348 (CN2011-ZH PDF)
配用: DC846A-ND - BOARD DELTA SIGMA ADC LTC2447
LTC2446/LTC2447
10
24467fa
MSB
BIT 28 BIT 27 BIT 26 BIT 25 BIT 24 BIT 23 BIT 22 BIT 21
BIT 20 BIT 19
BIT 0
LSB
Hi-Z
24467 F03
SIG
BIT 29
“0”
BIT 30
EOC
Hi-Z
CS
SCK
SDI
SDO
BUSY
BIT 31
1
0
EN
SGL
GLBL
A1
A0
OSR3
OSR2
OSR1
OSR0
TWOX
ODD
12345
6
7
89
10
11
12
13
14
32
+FS, the conversion result is clamped to the value corre-
sponding to the +FS + 1LSB. For differential input voltages
below –FS, the conversion result is clamped to the value
corresponding to –FS – 1LSB.
SERIAL INTERFACE PINS
The LTC2446/LTC2447 transmit the conversion results
and receive the start of conversion command through a
synchronous 3- or 4-wire interface. During the conver-
sion and sleep states, this interface can be used to assess
the converter status and during the data output state it is
used to read the conversion result and program the
speed, resolution and input channel.
rising edge of SCK. Bit 30 is shifted out of the device on the
first falling edge of SCK. The final data bit (Bit 0) is shifted
out on the falling edge of the 31st SCK and may be latched
on the rising edge of the 32nd SCK pulse. On the falling
edge of the 32nd SCK pulse, SDO goes HIGH indicating the
initiation of a new conversion cycle. This bit serves as EOC
(Bit 31) for the next conversion cycle. Table 2 summarizes
the output data format.
As long as the voltage on the IN+ and INpins is maintained
within the – 0.3V to (VCC + 0.3V) absolute maximum
operating range, a conversion result is generated for any
differential input voltage VIN from –FS = –0.5 VREF to
+FS = 0.5 VREF. For differential input voltages greater than
Table 2. LTC2446/LTC2447 Output Data Format
Differential Input Voltage
Bit 31
Bit 30
Bit 29
Bit 28
Bit 27
Bit 26
Bit 25
Bit 0
VIN*
EOC
DMY
SIG
MSB
VIN* ≥ 0.5 VREF**
0
0110
0
0
0.5 VREF** – 1LSB
0
0101
1
1
0.25 VREF**
0
0101
0
0
0.25 VREF** – 1LSB
0
0100
1
1
0
0100
0
0
–1LSB
0
0011
1
1
– 0.25 VREF**
0
0011
0
0
– 0.25 VREF** – 1LSB
0
0010
1
1
– 0.5 VREF**
0
0010
0
0
VIN* < –0.5 VREF**
0
0001
1
1
*The differential input voltage VIN = IN+ – IN. **The differential reference voltage VREF = REF+ – REF.
APPLICATIO S I FOR ATIO
WU
U
Figure 3. SDI Speed/Resolution, Channel Selection, and Data Output Timing
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