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参数资料
| 型号： | LTC2754BCUKG-16#TRPBF |
| 厂商： | Linear Technology |
| 文件页数： | 7/28页 |
| 文件大小： | 0K |
| 描述： | IC DAC 16BIT QUAD IOUT 52-QFN |
| 标准包装： | 2,000 |
| 系列： | SoftSpan™ |
| 设置时间： | 2µs |
| 位数： | 16 |
| 数据接口： | 串行，SPI? |
| 转换器数目： | 4 |
| 电压电源： | 单电源 |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 52-WFQFN 裸露焊盘 |
| 供应商设备封装： | 52-QFN（7x8）裸露焊盘 |
| 包装： | 带卷 (TR) |
| 输出数目和类型： | 8 电流，单极；8 电流，双极 |
| 采样率（每秒）： | * |
| 配用： | DC1546A-ND - BOARD DAC LTC2754-16 |
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LTC2754
15
2754f
Readback in M-Span Conguration
If the part is in M-Span conguration and a DAC Span
register is specied for readback, then the data shifted out
of SRO will reect the actual active span. The hardware-
congured output range is therefore software detectable
and available for use in programming.
Examples
1. Using a 24-bit instruction, load DAC A with the unipolar
range of 0V to 10V, output at zero volts and all other DACs
with the bipolar range of ±10V, outputs at zero volts. Note
all DAC outputs should change at the same time.
a) CS/LD
↓
Clock SDI = 0010 1111 0000 0000 0000 0011
b) CS/LD
↑
Input register- Range of all DACs set to bipolar
±10V.
c) CS/LD
↓
Clock SDI = 0010 0000 0000 0000 0000 0001
d) CS/LD
↑
Input register- Range of DAC A set to unipolar 0V
to 10V.
e) CS/LD
↓
Clock SDI = 0011 1111 1000 0000 0000 0000
f) CS/LD
↑
Input register- Code of all DACs set to midscale.
g) CS/LD
↓
Clock SDI = 0011 0000 0000 0000 0000 0000
h) CS/LD
↑
Input register- Code of DAC A set to zero code.
i) CS/LD
↓
Clock SDI = 0100 1111 XXXX XXXX XXXX XXXX
j) CS/LD
↑
Update all DACs for both Code and Range.
k) Alternatively steps i and j could be replaced with
LDAC
.
2. Using a 32-bit load sequence, load DAC C with bipolar
±2.5V and its output at zero volts. Use readback to check
Input register contents before updating the DAC output
(i.e., before copying Input register contents into DAC
register).
a) CS/LD
↓ (Note that after power-on, the code in
Input register is zero)
Clock SDI = 0000 0000 0011 0100 1000 0000
0000 0000
b) CS/LD
↑
Input register- Code of DAC C set to midscale
setting.
c) CS/LD
↓
Clock SDI = 0000 0000 0010 0100 0000 0000
0000 0100
Data out on SRO = 1000 0000 0000 0000 Veries
that Input register- Code DAC C is at midscale
setting.
d) CS/LD
↑
Input register- Range of DAC C set to Bipolar
±2.5V range.
e) CS/LD
↓
Clock SDI = 0000 0000 1010 0100 xxxx xxxx
xxxx xxxx
Data Out on SRO = 0000 0000 0000 0100
Veries that Input register- range of DAC C set to
Bipolar ±2.5V Range.
CS/LD↑
f) CS/LD
↓
Clock SDI = 0000 0000 0100 0100 xxxx xxxx
xxxx xxxx
g) CS/LD
↑
Update DAC C for both Code and Range
h) Alternatively steps f and g could be replaced with
LDAC
.
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