参数资料
| 型号： | LTC6994CS6-1#TRMPBF |
| 厂商： | Linear Technology |
| 文件页数： | 6/26页 |
| 文件大小： | 0K |
| 描述： | IC DELAY LINE TSOT-23-6 |
| 产品培训模块： | TimerBlox Family Timing Devices |
| 产品目录绘图： | LTC699_TSOT-23 |
| 特色产品： | TimerBlox? |
| 标准包装： | 1 |
| 系列： | TimerBlox® |
| 功能： | 可编程 |
| 可用的总延迟： | 1µs ~ 33.6s |
| 独立延迟数： | 1 |
| 电源电压： | 2.25 V ~ 5.5 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | SOT-23-6 细型，TSOT-23-6 |
| 供应商设备封装： | TSOT-23-6 |
| 包装： | 标准包装 |
| 配用： | DC1562A-E-ND - BOARD EVAL LTC6992-3 |
| 其它名称： | LTC6994CS6-1#TRMPBFDKR |
LTC6994-1/LTC6994-2
14
699412fb
operaTion
LTC6994-2 Functionality
Figures 5 details the basic operation of the LTC6994-2
when configured for noninverting operation (POL = 0). As
before, a rising edge on the IN pin initiates the timing and,
if IN remains high, OUT will transition high after tDELAY.
UnliketheLTC6994-1,fallingedgesaredelayedinthesame
way. When IN transitions low, OUT will follow after tDELAY.
If the input doesn’t remain high or low long enough for
OUT to follow, the timing will restart on the next transition.
Also unlike the LTC6994-1, the output pulse width can
never be less than tDELAY. Therefore, the LTC6994-2 can
generate pulses with a defined minimum width.
Figure 6 details the operation of the LTC6994-2 when the
output is inverted (POL = 1).
Figure 5. Both Edges Delayed Timing Diagram (LTC6994-2, POL = 0)
Figure 6. Both Edges Delayed (Inverting) Timing Diagram (LTC6994-2, POL = 1)
IN
OUT
tDELAY
tPD
tWIDTH
tPD
tDELAY
tPD
tDELAY
699412 F05
IN
OUT
tDELAY
tPD
tWIDTH
tDELAY
699412 F06
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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| LTC6994CS6-2TRMPBF | 制造商:LINER 制造商全称:Linear Technology 功能描述:TimerBlox: Delay Block/ Debouncer |
| LTC6994HDCB-1#PBF | 制造商:Linear Technology 功能描述:SC-Timing, Cut Tape Delay with Rising or Falling Edge Trigger |
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