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参数资料
| 型号： | LXT386BE |
| 英文描述： | PCM TRANSCEIVER|QUAD|CEPT PCM-30/E-1|CMOS|BGA|160PIN|PLASTIC |
| 中文描述： | 的PCM收发器|四|优税PCM-30/E-1 |的CMOS | BGA封装| 160PIN |塑料 |
| 文件页数： | 65/80页 |
| 文件大小： | 1112K |
| 代理商： | LXT386BE |
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Octal T1/E1/J1 Transceiver
—
LXT384
Datasheet
65
Table 48. Intel Mode Write Timing Characteristics
2
Parameter
Sym
Min.
Typ
1
Max
Unit
Test Conditions
Address setup time to latch
Tsalw
10
–
–
ns
Valid address latch pulse width
Tvl
30
–
–
ns
Latch active to active write setup time
Tslw
10
–
–
ns
Chip select setup time to active write
Tscsw
0
–
–
ns
Chip select hold time from inactive write
Thcsw
0
–
–
ns
Address hold time from inactive ALE
Thalw
5
ns
Data valid to write active setup time
Tsdw
40
–
–
ns
Data hold time to active write
Thdw
30
–
–
ns
Address setup time to WR inactive
Thaw
2
–
–
ns
Address hold time from WR inactive
Tsaw
6
–
–
ns
Valid write signal pulse width
Tvwr
60
–
–
ns
Inactive write to inactive INT delay time
Tint
–
–
10
ns
Chip select to RDY delay time
3
Tdrdy
0
–
12
ns
Active ready Low time
Tvrdy
–
–
40
ns
Inactive ready to tri-state delay time
3
Trdyz
–
–
3
ns
1. Typical figures are at 25 C and are for design aid only; not guaranteed and not subject to production
testing.
2. C
= 100pF on D0-D7, all other outputs are loaded with 50pF.
3. These times don't apply for Reset Register 0Ah, since RDY line goes low once during the cycle. Please
refer to Reset Operation and Host Mode sections for more information.
相关PDF资料 |
PDF描述 |
|---|---|
| LXT386LE | PCM TRANSCEIVER|QUAD|CEPT PCM-30/E-1|CMOS|QFP|100PIN|PLASTIC |
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参数描述 |
|---|---|
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