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参数资料
| 型号： | M30622SGP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, 16 MHz, MICROCONTROLLER, PQFP100 |
| 封装： | PLASTIC, QFP-100 |
| 文件页数： | 121/279页 |
| 文件大小： | 3919K |
| 代理商： | M30622SGP |
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Mitsubishi microcomputers
M16C / 62 Group
SINGLE-CHIP 16-BIT CMOS MICROCOMPUTER
Timing (Vcc = 3V)
204
VCC = 3V
Switching characteristics (referenced to VCC = 3V, VSS = 0V at Ta = 25oC, CM15 = “1” unless
otherwise specified)
Table 1.26.40. Memory expansion and microprocessor modes
(when accessing external memory area with wait, and select multiplexed bus)
Symbol
Standard
Measuring condition
Max.
Min.
Parameter
Unit
td(BCLK-AD)
Address output delay time
60
ns
th(BCLK-AD)
Address output hold time (BCLK standard)
4
ns
td(BCLK-CS)
Chip select output delay time
60
ns
th(BCLK-CS)
Chip select output hold time (BCLK standard)
4
ns
th(RD-AD)
Address output hold time (RD standard)
(Note)
td(BCLK-RD)
RD signal output delay time
60
ns
th(BCLK-RD)
RD signal output hold time
0
ns
th(WR-AD)
Address output hold time (WR standard)
(Note)
td(BCLK-WR)
WR signal output delay time
60
ns
td(BCLK-DB)
Data output delay time (BCLK standard)
80
ns
th(BCLK-DB)
Data output hold time (BCLK standard)
4
ns
td(DB-WR)
Data output delay time (WR standard)
(Note)
ns
th(BCLK-ALE)
ALE signal output hold time (BCLK standard)
– 4
ns
td(AD-ALE)
ALE signal output delay time (Address standard)
(Note)
ns
th(ALE-AD)
ALE signal output hold time(Address standard)
50
ns
th(BCLK-WR)
WR signal output hold time
0
ns
th(RD-CS)
Chip select output hold time (RD standard)
(Note)
th(WR-CS)
Chip select output hold time (WR standard)
(Note)
ns
td(AD-RD)
Post-address RD signal output delay time
ns
0
td(AD-WR)
Post-address WR signal output delay time
ns
0
tdZ(RD-AD)
Address output floating start time
ns
8
td(BCLK-ALE)
ALE signal output delay time (BCLK standard)
ns
60
Note: Calculated according to the BCLK frequency as follows:
th(RD – AD) =
f(BCLK) X 2
10
9
[ns]
th(WR – AD) =
f(BCLK) X 2
10
9
[ns]
th(RD – CS) =
f(BCLK) X 2
10
9
[ns]
th(WR – CS) =
f(BCLK) X 2
10
9
[ns]
td(DB – WR) =
f(BCLK) X 2
10
9
– 80
[ns]
X 3
td(AD – ALE) =
f(BCLK) X 2
10
9
– 45
[ns]
th(WR – DB) =
f(BCLK) X 2
10
9
[ns]
th(WR-DB)
Data output hold time (WR standard)
ns
(Note)
Figure 1.26.1
相关PDF资料 |
PDF描述 |
|---|---|
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| MPC8567EVTAQGGA | 32-BIT, 1000 MHz, RISC PROCESSOR, PBGA1023 |
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| MB96F347ASAPQC-GSE2 | 16-BIT, FLASH, 56 MHz, MICROCONTROLLER, PQFP100 |
相关代理商/技术参数 |
参数描述 |
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| M30622SG-XXXFS | 制造商:RENESAS 制造商全称:Renesas Technology Corp 功能描述:16-BIT SINGLE-CHIP MICROCOMPUTER M16C FAMILY |
| M30622SG-XXXGP | 制造商:RENESAS 制造商全称:Renesas Technology Corp 功能描述:16-BIT SINGLE-CHIP MICROCOMPUTER M16C FAMILY |
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