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参数资料
| 型号： | M30623MGP-XXXGP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, MROM, 24 MHz, MICROCONTROLLER, PQFP128 |
| 封装： | 14 X 20 MM, 0.50 MM PITCH, PLASTIC, LQFP-128 |
| 文件页数： | 85/104页 |
| 文件大小： | 1313K |
| 代理商： | M30623MGP-XXXGP |
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5. Electrical Characteristics
Rev.2.41
Jan 10, 2006
Page 79 of 96
REJ03B0001-0241
Figure 5.19
Timing Diagram (7)
Read timing
Write timing
BCLK
CSi
ALE
DBi
ADi
BHE
WR, WRL
WRH
Memory Expansion Mode, Microprocessor Mode
(for 3-wait setting and external area access)
BCLK
CSi
ALE
DBi
ADi
BHE
RD
tcyc
td(BCLK-CS)
30ns.max
td(BCLK-AD)
30ns.max
td(BCLK-ALE)
30ns.max
th(BCLK-ALE)
-4ns.min
td(BCLK-RD)
30ns.max
Hi-Z
tsu(DB-RD)
50ns.min
th(RD-DB)
0ns.min
th(BCLK-RD)
0ns.min
th(RD-AD)
0ns.min
th(BCLK-AD)
4ns.min
th(BCLK-CS)
4ns.min
tcyc
Hi-Z
td(BCLK-CS)
30ns.max
td(BCLK-AD)
30ns.max
td(BCLK-ALE)
30ns.max
th(BCLK-ALE)
-4ns.min
td(BCLK-WR)
30ns.max
th(BCLK-CS)
4ns.min
th(BCLK-AD)
4ns.min
th(WR-AD)
(0.5
× tcyc-10)ns.min
th(BCLK-WR)
0ns.min
td(BCLK-DB)
40ns.max
td(DB-WR)
(2.5
× tcyc-40)ns.min
th(BCLK-DB)
4ns.min
th(WR-DB)
(0.5
× tcyc-10)ns.min
tac2(RD-DB)
(3.5
× tcyc-60)ns.max
tcyc=
1
f(BCLK)
VCC1 = VCC2 = 3V
Measuring conditions
VCC1=VCC2=3V
Input timing voltage : VIL=0.6V, VIH=2.4V
Output timing voltage : VOL=1.5V, VOH=1.5V
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