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参数资料
| 型号： | M30878FJAGP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, FLASH, 32 MHz, MICROCONTROLLER, PQFP144 |
| 封装： | 20 X 20 MM, 0.50 MM PITCH, PLASTIC, LQFP-144 |
| 文件页数： | 86/91页 |
| 文件大小： | 2390K |
| 代理商： | M30878FJAGP |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页当前第86页第87页第88页第89页第90页第91页
A - 2
REVISION HISTORY
M32C/87 Group Datasheet
57
58
60
61
62
64
65
66
69
70
71
72
73
Electrical Characteristics
Table 5.22 Memory Expansion Mode and Microprocessor Mode th(WR-
DB)
expression on note 1 modified
Table 5.23 Memory Expansion Mode and Microprocessor Mode th(WR-
DB)
expression on note 1 modified; th(ALE-AD) expression on note 4
modified
Figure 5.3 Vcc1=Vcc2=5V Timing Diagram (1) tac1(RD-DB)
expression
on note 2 modified; th(WR-DB) and tw(ER) expressions on note 3 modified;
tcyc
expression added
Figure 5.4 Vcc1=Vcc2=5V Timing Diagram (2) tac2(RD-DB) and tac2(AD-
DB)
expressions on note 1 modified; th(ALE-AD) expressions on notes 1
and 2 modified; td(DB-WR) expression on note 2 modified; tcyc expression
added
Figure 5.5 Vcc1=Vcc2=5V Timing Diagram (3)
NMI input diagram added
Table 5.24 Electrical Characteristics
VOH values changed;RPULLUP and
Icc values modified
Table 5.25 A/D Conversion Characteristics tCONV
value modified
Table 5.28 Memory Expansion Mode and Microprocessor Mode
tac1(RD-DB)
expression on note 1 modified; tac2(RD-DB) expression on
note 1 added
Table 5.40 Memory Expansion Mode and Microprocessor Mode
th(BCLK-AD), th(BCLK-CS) and th(BCLK-RD)
values modified; th(WR-AD)
expression on note 1 modified
Table 5.41 Memory Expansion Mode and Microprocessor Mode
th(BCLK-AD), th(BCLK-CS) and th(BCLK-RD)
values modified; th(WR-AD)
expression on note 1 modified; th(ALE-AD) expression on note 4 modified
Figure 5.7 Vcc1=Vcc2=3.3V Timing Diagram (1) th(BCLK-AD), th(BCLK-
CS)
and th(BCLK-RD)
values modified; tac1(AD-DB) expression on note 2
modified; th(WR-DB), th(WR-AD) and tw(WR) expression on note 3 modified;
tcyc
expression added
Figure 5.8 Vcc1=Vcc2=3.3V Timing Diagram (2) tac2(RD-DB) and
tac1(AD-DB)
expressions on note 1 modified; th(ALE-AD) expressions on
notes 1 and 2 modified; td(WR-AD), td(DB-WR) and th(WR-DB) expressions
on note 2 modified; tcyc expression added
Figure 5.9 Vcc1=Vcc2=3.3V Timing Diagram (3)
NMI input diagram
added
1.01
Aug. 29, 05
17
Overview
Tables 1.6 Pin Description
Intelligent I/O functions modified
29
Special Function Register (SFR)
The G1BCR0 register Value after reset modified
The G1BCR1 register Value after reset modified
49
Electrical Characteristics
Table 5.3 Electrical Characteristics
ICC standard value modified
Rev.
Date
Description
Page
Summary
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PDF描述 |
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参数描述 |
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