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参数资料
| 型号： | M312L2923BG0-B0 |
| 厂商： | SAMSUNG SEMICONDUCTOR CO. LTD. |
| 英文描述： | TVS BIDIRECT 1500W 150V SMC |
| 中文描述： | DDR SDRAM的注册模块 |
| 文件页数： | 7/18页 |
| 文件大小： | 274K |
| 代理商： | M312L2923BG0-B0 |
DDR SDRAM
1GB, 2GB Registered DIMM
Rev. 1.1 August. 2003
DQ4
DQ5
DQ6
DQ7
DQ0
DQ1
DQ2
DQ3
DQS0
DQ12
DQ13
DQ14
DQ15
DQ8
DQ9
DQ10
DQ11
DQS9
(DM0)
DQ20
DQ21
DQ22
DQ23
DQ16
DQ17
DQ18
DQ19
DQS11
(DM2)
DQ28
DQ29
DQ30
DQ31
DQ24
DQ25
DQ26
DQ27
DQS12
(DM3)
DQ36
DQ37
DQ38
DQ39
DQ32
DQ33
DQ34
DQ35
DQS13
(DM4)
DQ44
DQ45
DQ46
DQ47
DQ40
DQ41
DQ42
DQ43
DQS14
(DM5)
DQ52
DQ53
DQ54
DQ55
DQ48
DQ49
DQ50
DQ51
DQ60
DQ61
DQ62
DQ56
DQ57
DQ58
DQ59
DQS16
(DM7)
RCS0
RCS1
DQS4
DQS1
DQS5
DQS2
DQS3
DQS15
(DM6)
DQS6
DQS7
DQS
I/O 3
I/O 2
I/O 1
I/O 0
D0
CS
DM
DQS
I/O 3
I/O 2
I/O 1
I/O 0
D1
DM
DQS
I/O 3
I/O 2
I/O 1
I/O 0
D2
DM
DQS
I/O 3
I/O 2
I/O 1
I/O 0
D3
DM
DQS
I/O 3
I/O 2
I/O 1
I/O 0
D4
DM
DQS
I/O 3
I/O 2
I/O 1
I/O 0
D5
DM
DQS
I/O 3
I/O 2
I/O 1
I/O 0
D6
DM
DQS
I/O 3
I/O 2
I/O 1
I/O 0
D7
DM
DQS
I/O 0
I/O 1
I/O 2
I/O 3
D9
DM
DQS
I/O 0
I/O 1
I/O 2
I/O 3
D10
DM
DQS
I/O 0
I/O 1
I/O 2
I/O 3
D11
DM
DQS
I/O 0
I/O 1
I/O 2
I/O 3
D12
DM
DQS
I/O 0
I/O 1
I/O 2
I/O 3
D13
DM
DQS
I/O 0
I/O 1
I/O 2
I/O 3
D14
DM
DQS
I/O 0
I/O 1
I/O 2
I/O 3
D15
DM
DQS
I/O 0
I/O 1
I/O 2
I/O 3
D16
DM
DQS10
(DM1)
V
SS
DQS
I/O 3
I/O 2
I/O 1
I/O 0
D18
DM
DQS
I/O 3
I/O 2
I/O 1
I/O 0
D19
DM
DQS
I/O 3
I/O 2
I/O 1
I/O 0
D20
DM
DQS
I/O 3
I/O 2
I/O 1
I/O 0
D21
DM
DQS
I/O 3
I/O 2
I/O 1
I/O 0
D22
DM
DQS
I/O 3
I/O 2
I/O 1
I/O 0
D23
DM
DQS
I/O 3
I/O 2
I/O 1
I/O 0
D24
DM
DQS
I/O 3
I/O 2
I/O 1
I/O 0
D25
DM
DQS
I/O 0
I/O 1
I/O 2
I/O 3
D27
DM
DQS
I/O 0
I/O 1
I/O 2
I/O 3
D28
DM
DQS
I/O 0
I/O 1
I/O 2
I/O 3
D29
DM
DQS
I/O 0
I/O 1
I/O 2
I/O 3
D30
DM
DQS
I/O 0
I/O 1
I/O 2
I/O 3
D31
DM
DQS
I/O 0
I/O 1
I/O 2
I/O 3
D32
DM
DQS
I/O 0
I/O 1
I/O 2
I/O 3
D33
DM
DQS
I/O 0
I/O 1
I/O 2
I/O 3
D34
DM
Notes:
1. DQ-to-I/O wiring is shown as recommended but may be changed.
2. DQ/DQS/DM/CKE/CS relationships must be maintained as shown.
3. DQ, DQS, DM/DQS resistors: 22 Ohms.
RA0 - RA12
A0-A12:
DDR SDRAM
D0 - D35
RAS:
DDR SDRAM
D0 - D35
CAS:
DDR SDRAM
D0 - D35
CKE:
D0 - D17
RCAS
RCKE0
RCKE1
CKE:
DDR SDRAM
D18 - D35
WE:
DDR SDRAM
D0 - D35
PCK
PCK
BA0-BA1:
DDR SDRAM
D0 - D35
RAS
CAS
CKE0
CKE1
WE
RCS1
CS1
BA0-BA1
A0-A12
R
E
G
I
S
T
E
R
RRAS
RWE
CS0
RCS0
RESET
A0
Serial PD
A1
A2
SA0
SA1
SA2
SCL
WP
SDA
V
SS
D0 - D35
D0 - D35
V
DD
/V
DDQ
D0 - D35
D0 - D35
VREF
V
DDSPD
SPD
2GB, 256M x 72 ECC Module [M312L5720BG0]
(Populated as 2 bank of x4 DDR SDRAM Module)
Functional Block Diagram
PLL*
CK0,CK0
* Wire per Clock Loading table/wiring Diagrams
CB0
CB1
CB2
CB3
DQS8
DQS
I/O 3
I/O 2
I/O 1
I/O 0
D8
DM
DQS
I/O 3
I/O 2
I/O 1
I/O 0
D26
DM
CB4
CB5
CB6
CB7
DQS17
(DM8)
DQS
I/O 0
I/O 1
I/O 2
I/O 3
D17
DM
DQS
I/O 0
I/O 1
I/O 2
I/O 3
D35
DM
CS
CS
CS
CS
CS
CS
CS
CS
CS
CS
CS
CS
CS
CS
CS
CS
CS
CS
CS
CS
CS
CS
CS
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CS
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CS
CS
CS
CS
CS
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