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参数资料
| 型号： | M34502M2-XXXFP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 4-BIT, MROM, MICROCONTROLLER, PDSO24 |
| 封装： | 5.30 X 10.10 MM, 0.80 MM PITCH, PLASTIC, SSOP-24 |
| 文件页数： | 12/116页 |
| 文件大小： | 896K |
| 代理商： | M34502M2-XXXFP |
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4502 Group
Rev.3.01
2005.02.02
page 109 of 112
REJ03B0105-0301
Basic timing diagram
Voltage drop detection circuit characteristics
(Ta = –20 °C to 85 °C, unless otherwise noted)
Test conditions
Ta = 25 °C
RAM back-up mode
VDD = 5.0 V
(POF instruction execution) (Note 2)
Parameter
Detection voltage (Note 1)
Operation current of voltage
drop detection circuit
Symbol
VRST
IRST
Limits
Unit
Min.
2.7
3.3
Typ.
3.5
50
Max.
4.2
3.7
100
V
A
Notes 1: The detected voltage (VRST) is defined as the voltage when reset occurs while the supply voltage (VDD) is falling.
2: The voltage drop detection circuit is operating in the RAM back-up with the POF instruction (It stops in the RAM back-up with the POF2 instruction).
XIN : high-speed mode
(System clock = f(XIN))
Parameter
Pin name
Machine cycle
MiMi+1
D0, D1, D2/C, D3/K,
D4, D5
P00–P03
P10–P13
P00–P03
P10–P13
P20, P21
XIN : middle-speed mode
(System clock = f(XIN)/2)
P20, P21
Clock
Port D output
Port D input
Port P0, P1, P2, P3
output
Port P0, P1, P2, P3
input
CNTR
Timer output
XIN : low-speed mode
(System clock = f(XIN)/4)
XIN : default mode
(System clock = f(XIN)/8)
D0, D1, D2/C, D3/K,
D4, D5
INT
Interrupt input
CNTR
Timer input
P30, P31
相关PDF资料 |
PDF描述 |
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| M34508G4HGP | 4-BIT, MROM, 6 MHz, MICROCONTROLLER, PDSO20 |
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