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参数资料
| 型号： | M38225E4DFP |
| 厂商： | Mitsubishi Electric Corporation |
| 英文描述： | SINGLE-CHIP 8-BIT CMOS MICROCOMPUTER |
| 中文描述： | 单芯片8位CMOS微机 |
| 文件页数： | 18/78页 |
| 文件大小： | 998K |
| 代理商： | M38225E4DFP |
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18
SINGLE-CHIP 8-BIT CMOS MICROCOMPUTER
3822 Group
MITSUBISHI MICROCOMPUTERS
Real time port
function output
A-D conversion input
A-D trigger input
Diagram No.
(1)
Related SFRs
PULL register A
Segment output enable
register
Input/Output
Input/output,
individual ports
Name
Port P0
Pin
Non-Port Function
LCD segment output
I/O Format
Table 9 List of I/O port function
P0
0
/SEG
16
–
P0
7
/SEG
23
P1
0
/SEG
24
–
P1
7
/SEG
31
P2
0
–
P2
7
P3
4
/SEG
12
–
P3
7
/SEG
15
P4
0
P4
1
/
φ
P4
2
/INT
0,
P4
3
/INT
1
P4
4
/R
X
D
P4
5
/T
X
D
P4
6
/S
CLK
P4
7
/S
RDY
P5
0
/INT
2
,
P5
1
/INT
3
P5
2
/RTP
0
,
P5
3
/RTP
1
P5
4
/CNTR
0
Port P1
Port P2
Port P3
Port P4
Input/output,
individual bits
Input
Input
Input/output,
individual bits
CMOS compatible
input level
CMOS 3-state output
CMOS compatible
input level
CMOS 3-state output
CMOS compatible
input level
CMOS compatible
input level
CMOS compatible
input level
CMOS 3-state output
CMOS compatible
input level
CMOS 3-state output
CMOS compatible
input level
CMOS 3-state output
CMOS compatible
input level
CMOS 3-state output
LCD common output
LCD segment output
Key input (key-on
wake-up) interrupt
input
LCD segment output
φ
clock output
External interrupt input
Serial I/O function I/O
External interrupt input
Timer X function I/O
Timer Y function input
Timer 2 function output
PULL register A
Interrupt control register 2
PULL register A
Segment output enable
register
PULL register B
φ
output control register
PULL register B
Interrupt edge selection
register
PULL register B
Serial I/O control register
Serial I/O status register
UART control register
PULL register B
Interrupt edge selection
register
PULL register B
Timer X mode register
PULL register B
Timer X mode register
PULL register B
Timer Y mode register
PULL register B
Timer 123 mode register
PULL register B
A-D control register
PULL register A
CPU mode register
(2)
(3)
(4)
(6)
(7)
(5)
(2)
(8)
(9)
Port P5
(2)
Input/output,
individual bits
(10)
P5
5
/CNTR
1
(11)
(12)
(13)
(12)
(14)
P5
6
/T
OUT
P5
7
/ADT
P6
0
/AN
0
–
P6
7
/AN
7
(15)
P7
0
/X
COUT
P7
1
/X
CIN
COM
0
–
COM
3
SEG
0
–
SEG
11
(16)
(17)
(18)
Input/output,
individual bits
Input/output,
individual bits
Output
Output
Sub-clock
generating circuit I/O
Notes1:
How to use double-function ports as function I/O ports, refer to the applicable sections.
2:
Make sure that the input level at each pin is either 0 V or V
CC
during execution of the STP instruction. When an input level is at an intermediate po-
tential, a current will flow V
CC
to V
SS
through the input-stage gate.
Port P6
Port P7
Common
Segment
LCD mode register
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PDF描述 |
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