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参数资料
| 型号： | M38867E8AFS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, UVPROM, 5 MHz, MICROCONTROLLER, CQCC80 |
| 封装： | 0.80 MM PITCH, CERAMIC, LCC-80 |
| 文件页数： | 320/380页 |
| 文件大小： | 4158K |
| 代理商： | M38867E8AFS |
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1-19
3886 Group User’s Manual
HARDWARE
Fig. 13 Port block diagram (2)
FUNCTIONAL DESCRIPTION
Serial I/O1 input
(11) Port P44
Data bus
Serial I/O1 enable bit
Receive enable bit
Port latch
P4 output structure selection bit
1
(12) Port P45
Data bus
Serial I/O1 enable bit
Transmit enable bit
Serial I/O1 output
P45/TXD P-channel output disable bit
Port latch
(13) Port P46
Serial I/O1
synchronous clock selection bit
Data bus
Serial I/O1 clock output
Serial I/O1 external clock input
Serial I/O1 mode selection bit
Serial I/O1 enable bit
Port latch
Serial I/O1 enable bit
OBF10 output enable bit
OBF10 output
P4 output structure selection bit
(14) Port P47
(15) Port P50
(16) Ports P51,P52,P53
1. The input level can be switched between CMOS compatible input level and TTL level by the P4 input level selection bit of the port control
register 2 (address 002F16).
2. The input level can be switched between CMOS compatible input level and TTL level by the P4 input level selection bit of the port control
register 2 (address 002F16).
The port P8 and port P4 input register can be switched by the P8 function selection bit of the port control register 2 (address 002F16).
3. The input level can be switched between CMOS compatible input level and TTL level by the input level selection bit of the data bus buffer
control register (address 002A16).
(9) Port P42
OBF00 output enable bit
OBF00 output
P4 output structure selection bit
INT0 interrupt input
(10) Port P43
OBF01 output enable bit
OBF01 output
Data bus
Port latch
Direction
register
1
P4 output structure selection bit
INT1 interrupt input
Data bus
Port latch
Data bus buffer enable bit
INT20, INT30, INT40 interrupt input
S0,R,W input
Data bus
Port latch
Data bus buffer enable bit
A0 input
Data bus buffer
enable bit
Data bus buffer
enable bit
Serial I/O1 mode selection bit
Serial I/O1 enable bit
SRDY1 output enable bit
Data bus
Serial I/O1 ready output
Port latch
Data bus buffer function
selection bit
S1 input
3
Data bus buffer function
selection bit
2
Data bus
Port latch
Direction
register
1
2
Direction
register
Direction
register
1
2
1
2
Direction
register
Direction
register
Direction
register
3
Direction
register
3
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