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参数资料
| 型号： | M44C092 |
| 厂商： | ATMEL CORP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 4-BIT, MROM, 4 MHz, MICROCONTROLLER, PDSO20 |
| 封装： | SSO-20 |
| 文件页数： | 61/84页 |
| 文件大小： | 643K |
| 代理商： | M44C092 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页当前第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页
M44C892
M44C092
Rev. A5, 14-Dec-01
64 (84)
Combination Mode Timer 3 and SSI
8–bit Counter 3
RES
Compare 3/1
T3CO1
T3CP
T3CO2
Timer 3 – control
T3O
CL3
T3I
T3EX
SYSCL
T1OUT
POUT
I/O–bus
Compare 3/2
T3CM1
T3CM2
T3C
T3ST
Modulator 3
Demodu–
lator 3
M2
Control
SO
TOG3
INT5
RES
CM31
T3I
T3EX
SI
SC
T3M
T3CS
CP3
13877
8–bit shift register
MSB
LSB
Shift_CL
SO
SIC1
SIC2
SISC
SCLI
Control
STB
SRB
SI
Output
INT3
I/O–bus
SSI–control
TOG2
POUT
T1OUT
SYSCL
SI
MCL_SC
MCL_SD
Transmit buffer
Receive buffer
SC
SI
Figure 74. Combination Timer 3 and SSI
Combination mode 6: FSK modulation
SSI mode 1:
8-bit shift register internal data output (SO) to the Timer 3
Timer 3 mode 8:
FSK modulation with shift register data (SO)
The two compare registers are used to generarte two varied time intervals. The SSI data output selects which compare
register is used for the output frequency generation. A ’0’-level at the SSI data output enables the compare register 1
and a ’1’-level enables the compare register 2. The both compare and compare mode registers must be programmed
to generate the two frequencies via the output toggle flip-flop. The SSI can be supplied with the toggle signal of Timer 2
or any other clock source. The Timer 3 counter is driven by an internal or external clock source.
0 123 401 234 0120
Counter 3
CM31
CM32
SO
13893
120 120 120 120 120 120 120 12 34 0
T3R
12
T3O
3
01
0
40
Figure 75. FSK modulation
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