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参数资料
| 型号： | MACH211SP-15JC |
| 厂商： | Electronic Theatre Controls, Inc. |
| 英文描述： | High-Performance EE CMOS In-System Programmable Logic |
| 中文描述： | 高性能电子工程的CMOS在系统可编程逻辑 |
| 文件页数： | 14/37页 |
| 文件大小： | 251K |
| 代理商： | MACH211SP-15JC |
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14
MACH211SP-12/15/20 (Com’l)
CAPACITANCE (Note 1)
Parameter
Symbol
Parameter Description
Test Conditions
Typ
Unit
C
IN
Input Capacitance
V
IN
= 2.0 V
V
CC
= 5.0 V, T
A
= 25
°
C
f = 1 MHz
6
pF
C
OUT
Output Capacitance
V
OUT
= 2.0 V
8
pF
SWITCHING CHARACTERISTICS over COMMERCIAL operating ranges (Note 2)
Parameter
Symbol
Parameter Description
-12
-15
-20
Unit
Min
Max
Min
Max
Min
Max
t
PD
Input, I/O, or Feedback to Combinatorial Output
(Note 3)
12
15
20
ns
t
S
Setup Time from Input, I/O, or
Feedback to Clock
D-type
7
10
13
ns
T-type
8
11
14
ns
t
H
Register Data Hold Time
0
0
0
ns
t
CO
Clock to Output (Note 3)
8
10
12
ns
t
WL
Clock Width
LOW
6
6
8
ns
t
WH
HIGH
6
6
8
ns
f
MAX
Maximum
Frequency
(Note 1)
External
Feedback
1/(t
S
+ t
CO
)
D-type
66.7
50
40
MHz
T-type
62.5
47.6
38.5
MHz
Internal Feedback (f
CNT
)
D-type
83.3
66.6
50
MHz
T-type
76.9
62.5
47.6
MHz
No
Feedback
1/(t
WL
+ t
WH
)
83.3
83.3
62.5
MHz
t
SL
Setup Time from Input, I/O, or Feedback to Gate
7
10
13
ns
t
HL
Latch Data Hold Time
0
0
0
ns
t
GO
Gate to Output
10
11
12
ns
t
GWL
Gate Width LOW
6
6
8
ns
t
PDL
Input, I/O, or Feedback to Output Through
Transparent Input or Output Latch
14
17
22
ns
t
SIR
Input Register Setup Time
2
2
2
ns
t
HIR
Input Register Hold Time
2
2.5
3
ns
t
ICO
Input Register Clock to Combinatorial Output
15
18
23
ns
t
ICS
Input Register Clock to Output Register
Setup
D-type
12
15
20
ns
T-type
13
16
21
ns
t
WICL
Input Register Clock Width
LOW
6
6
8
ns
t
WICH
HIGH
6
6
8
ns
f
MAXIR
Maximum Input Register
Frequency
1/(t
WICL
+ t
WICH
)
83.3
83.3
62.5
MHz
t
SIL
Input Latch Setup Time
2
2
2
ns
t
HIL
Input Latch Hold Time
2
2.5
3
ns
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