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参数资料
型号： MAX1028BCEP+
厂商： Maxim Integrated Products
文件页数： 21/22页
文件大小： 0K
描述： IC ADC 10-BIT 300KSPS 20-QSOP
产品培训模块： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
标准包装： 50
位数： 10
采样率（每秒）： 300k
数据接口： MICROWIRE?，QSPI?，串行，SPI?
转换器数目： 1
功率耗散（最大）： 727mW
电压电源： 单电源
工作温度： 0°C ~ 70°C
安装类型： 表面贴装
封装/外壳： 20-SSOP（0.154"，3.90mm 宽）
供应商设备封装： 20-QSOP
包装： 管件
输入数目和类型： 12 个单端，单极；12 个单端，双极；6 个差分，单极；6 个差分，双极
产品目录页面： 1395 (CN2011-ZH PDF)
MAX1026/MAX1028/MAX1030
10-Bit 300ksps ADCs with FIFO,
Temp Sensor, Internal Reference
8
_______________________________________________________________________________________
Pin Description
PIN
MAX1030
TQFN
MAX1030
QSOP
MAX1028
MAX1026
NAME
FUNCTION
1, 17, 19,
25
—
N.C.
No Connection. Not internally connected.
2–12, 26,
27, 28
1–14
—
AIN0–13
Analog Inputs
—
1–10
—
AIN0–9
Analog Inputs
—
1–6
AIN0–5
Analog Inputs
13
15
—
REF-/AIN14
Negative Input for External Differential Reference/Analog Input 14.
See Table 3 for details on programming the setup register.
—
11
—
REF-/AIN10
Negative Input for External Differential Reference/Analog Input 10.
See Table 3 for details on programming the setup register.
—
7
REF-/AIN6
Negative Input for External Differential Reference/Analog Input 6.
See Table 3 for details on programming the setup register.
14
16
—
CNVST/
AIN15
Active-Low Conversion Start Input/Analog Input 15. See Table 3
for details on programming the setup register.
—
12
—
CNVST/
AIN11
Active-Low Conversion Start Input/Analog Input 11. See Table 3
for details on programming the setup register.
——
—
8
CNVST/
AIN7
Active-Low Conversion Start Input/Analog Input 7. See Table 3 for
details on programming the setup register.
15
17
13
9
REF+
Positive Reference Input. Bypass to GND with a 0.1F capacitor.
16
18
14
10
GND
Ground
18
19
15
11
VDD
Power Input. Bypass to GND with a 0.1F capacitor.
20
16
12
SCLK
Serial Clock Input. Clocks data in and out of the serial interface.
(Duty cycle must be 40% to 60%.) See Table 3 for details on
programming the clock mode.
21
17
13
CS
Active-Low Chip-Select Input. When
CS is low, the serial interface
is enabled. When
CS is high, DOUT is high impedance.
22
18
14
DIN
Serial Data Input. DIN data is latched into the serial interface on
the rising edge of SCLK.
23
19
15
DOUT
Serial Data Output. Data is clocked out on the falling edge of
SCLK. High impedance when
CS is connected to VDD.
24
20
16
EOC
End of Conversion Output. Data is valid after
EOC pulls low.
—
EP
Exposed Pad (TQFN Only). Connect EP to GND.
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PDF描述
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