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参数资料
| 型号： | MAX11666AUB/V+T |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 6/28页 |
| 文件大小： | 0K |
| 描述： | IC ADC 12BIT SRL 500KSPS 10UMAX |
| 标准包装： | 2,500 |
| 位数： | 12 |
| 采样率（每秒）： | 500k |
| 数据接口： | MICROWIRE?，QSPI?，串行，SPI? |
| 转换器数目： | 1 |
| 功率耗散（最大）： | 707.3mW |
| 电压电源： | 模拟和数字 |
| 工作温度： | -40°C ~ 125°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 10-TFSOP，10-MSOP（0.118"，3.00mm 宽）裸露焊盘 |
| 供应商设备封装： | 10-uMAX-EP |
| 包装： | 带卷 (TR) |
| 输入数目和类型： | 2 个单端，单极 |
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14 _____________________________________________________________________________________
MAX11661–MAX11666
500ksps, Low-Power,
Serial 12-/10-/8-Bit ADCs
ELECTRICAL CHARACTERISTICS (MAX11661) (continued)
(VDD = 2.2V to 3.6V. fSCLK = 8MHz, 50% duty cycle, 500ksps. CDOUT = 10pF, TA = -40NC to +125NC, unless otherwise noted. Typical
values are at TA = +25NC.) (Note 1)
Note 1: Limits at TA = -40NC are guaranteed by design and not production tested.
Note 2: All timing specifications given are with a 10pF capacitor.
Note 3: Guaranteed by design in characterization; not production tested.
PARAMETER
SYMBOL
CONDITIONS
MIN
TYP
MAX
UNITS
DIGITAL OUTPUT (DOUT)
Output High Voltage
VOH
ISOURCE = 200A
0.85 x
VVDD
V
Output Low Voltage
VOL
ISINK = 200A
0.15 x
VVDD
V
High-Impedance Leakage
Current
IOL
Q
1.0
F
A
High-Impedance Output
Capacitance
COUT
4
pF
POWER SUPPLY
Positive Supply Voltage
VDD
2.2
3.6
V
Positive Supply Current
(Full-Power Mode)
IVDD
VAIN = VGND
1.76
mA
Positive Supply Current
(Full-Power Mode), No Clock
IVDD
1.48
mA
Power-Down Current
IPD
Leakage only
1.3
10
F
A
Line Rejection
VDD = 2.2V to 3.6V
0.17
LSB/V
TIMING CHARACTERISTICS (Note 2)
Quiet Time
tQ
(Note 3)
4
ns
CS Pulse Width
t1
(Note 3)
10
ns
CS Fall to SCLK Setup
t2
(Note 3)
5
ns
CS Falling Until DOUT High-
Impedance Disabled
t3
(Note 3)
1
ns
Data Access Time After SCLK
Falling Edge
t4
Figure 2, VDD = 2.2V to 3.6V
15
ns
SCLK Pulse Width Low
t5
Percentage of clock period (Note 3)
40
60
%
SCLK Pulse Width High
t6
Percentage of clock period (Note 3)
40
60
%
Data Hold Time From SCLK
Falling Edge
t7
Figure 3
5
ns
SCLK Falling Until DOUT High
Impedance
t8
Figure 4 (Note 3)
2.5
14
ns
Power-Up Time
Conversion cycle (Note 3)
1
Cycle
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