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参数资料
| 型号： | MAX14824GTG+T |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 16/28页 |
| 文件大小： | 0K |
| 描述： | IC IO-LINK MASTER TXRX 24TQFN |
| 标准包装： | 2,500 |
| 系列： | * |
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23
MAX14824
IO-Link Master Transceiver
Figure 8. SPI Write Cycle
Figure 9. SPI Read Cycle
SPI Interface
The device communicates through an SPI-compatible
4-wire serial interface. The interface has three inputs—
clock (SCLK), chip select (CS), and data in (SDI)—and
one output, data out (SDO). The maximum SPI clock rate
for the device is 12MHz. The SPI interface complies with
clock polarity CPOL = 0 and clock phase CPHA = 0 (see
Figure 8 and Figure 9).
The SPI interface is not available when V5 or VL is not
present.
Table 6. Auto Wake-Up Polarity Generation
WuEnBit
WUEN
MODE
0
Low
Normal operation
0
High
Wake-up generation mode
1
Low
Wake-up generation mode
1
High
Wake-up generation mode
R0
D7
D6
D5
D4
D3
D2
D1
D0
SCLK
A_ = DEVICE ADDRESS
R_ = REGISTER ADDRESS
D_ = DATA BIT
= CLOCK EDGE WHEN LOGIC IS LATCHED
SDI
W0
A3
A2
A1
A0
R1
CS
SCLK
R1
R0
A3
A2
A1
A0
CS
D7
D6
D5
D4
D3
D2
D1
D0
A_ = DEVICE ADDRESS
R_ = REGISTER ADDRESS
D_ = DATA BIT
= CLOCK EDGE WHEN LOGIC IS LATCHED
= CLOCK EDGE AT WHICH LOGIC IS WRITTEN
SDI
0
R
SDO
X
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