参数资料
型号: MAX6649YMUA+
厂商: Maxim Integrated
文件页数: 3/16页
文件大小: 194K
描述: IC SENSOR REMOTE SMBUS 8UMAX
产品培训模块: Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
标准包装: 50
功能: 温度监控系统(传感器)
传感器类型: 内部和外部
感应温度: -55°C ~ 125°C,外部传感器
精确度: ±3°C 本地(最大),±3.2°C 远程(最大)
拓扑: ADC,多路复用器,寄存器库
输出类型: I²C?/SMBus?
输出警报:
输出风扇:
电源电压: 3 V ~ 5.5 V
工作温度: -55°C ~ 125°C
安装类型: 表面贴装
封装/外壳: 8-TSSOP,8-MSOP(0.118",3.00mm 宽)
供应商设备封装: 8-uMAX
包装: 管件
+145癈 Precision SMBus-Compatible Remote/
Local Sensors with Overtemperature Alarms
3
ELECTRICAL CHARACTERISTICS (continued)
(V
CC
= 3.0V to 5.5V, T
A
= -55癈 to +125癈, unless otherwise specified. Typical values are at V
CC
= 3.3V and T
A
= +100癈.) (Note 1)
PARAMETER
SYMBOL
CONDITIONS
MIN
TYP
MAX     UNITS
ALERT, OVERT
I
SINK
 = 1mA
 
 
0.4
Output Low Voltage
 
I
SINK
 = 4mA
 
 
0.6
V
Output High Leakage Current
 
V
OH
 = 5.5V
 
 
1
SMBus-COMPATIBLE INTERFACE (SCLK AND SDA)
Logic Input Low Voltage
V
IL
 
 
 
 
0.8
V
V
CC
 = 3.0V
2.2
 
 
Logic Input High Voltage
V
IH
V
CC
 = 5.5V
2.6
 
 
V
Input Leakage Current
I
LEAK
 
V
IN
 = V
GND
 or V
CC
 
-1
 
+1
Output Low-Sink Current
I
SINK
 
V
OL
 = 0.6V
6
 
 
mA
Input Capacitance
C
IN
 
 
 
5
 
pF
SMBus-COMPATIBLE TIMING (Note 2) 
Serial Clock Frequency
f
SCLK
 
(Note 3)
 
 
100
kHz
Bus Free Time Between STOP
and START Condition
t
BUF
 
 
4.7
 
 
Repeat START Condition Setup
Time
t
SU:STA
     
4.7
 
 
START Condition Hold Time
t
HD:STA
     10% of SDA to 90% of SCLK
4
 
 
STOP Condition Setup Time
t
SU:STO
     90% of SCLK to 90% of SDA
4
 
 
Clock Low Period
t
LOW
 
10% to 10%
4.7
 
 
Clock High Period
t
HIGH
 
90% to 90%
4
 
 
Data Setup Time
t
SU:DAT
     
250
 
 
ns
Data Hold Time
t
HD:DAT
     (Note 4)
250
 
 
ns
Receive SCLK/SDA Rise Time
t
R
 
 
 
 
1
Receive SCLK/SDA Fall Time
t
F
 
 
 
 
300
ns
Pulse Width of Spike
Suppressed
t
SP
 
 
0
 
50
ns
SMBus Timeout
t
TIMEOUT
    SDA low period for interface reset
25
37
55
ms
Note 1: All parameters tested at a single temperature. Specifications over temperature are guaranteed by design.
Note 2: Timing specifications guaranteed by design.
Note 3: The serial interface resets when SCLK is low for more than t
TIMEOUT
.
Note 4: A transition must internally provide at least a hold time to bridge the undefined region (300ns max) of SCLKs falling edge.
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