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参数资料
| 型号： | MAX6886ETP+ |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 3/13页 |
| 文件大小： | 0K |
| 描述： | IC SUPERVISOR HEX 20-TQFN |
| 产品培训模块： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 标准包装： | 60 |
| 类型： | 多压监控器 |
| 监视电压数目： | 6 |
| 输出： | 开路漏极或开路集电极 |
| 复位： | 低有效 |
| 复位超时： | 可调节/可选择 |
| 电压 - 阀值： | 6 种可选阀值组合 |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 20-WQFN 裸露焊盘 |
| 供应商设备封装： | 20-TQFN-EP（5x5） |
| 包装： | 管件 |
Pin-Selectable, Hex Power-Supply
Supervisory Circuit
ELECTRICAL CHARACTERISTICS (continued)
(V IN1 –V IN4 or V CC = 2.7V to 5.8V, WDI = GND, TH0–TH4 = MARGIN = MR = DBP, T A = -40°C to +85°C, unless otherwise noted.
Typical values are at T A = +25°C.) (Notes 1, 2)
PARAMETER
MR, MARGIN , TH0–TH4, WDI
Input Voltage
SYMBOL
V IL
V IH
CONDITIONS
MIN
1.4
TYP
MAX
0.6
UNITS
V
MR Input Pulse Width
MR Glitch Rejection
t MR
1
100
μs
ns
MR to RESET Delay
t D- MR
200
ns
MR to Internal DBP Pullup
Current
MARGIN to Internal DBP Pullup
Current
I MR
I MARGIN
V MR = 1.4V
V MARGIN = 1.4V
5
5
10
10
15
15
μA
μA
TH0–TH4 Input Current
-100
+100
nA
WDI Pulldown Current
I WDI
V WDI = 0.6V
5
10
15
μA
WDI Input Pulse Width
t WDI
50
ns
Watchdog Default Timeout Period
Watchdog Adjustable Timeout
Period
t WD
t WD-ADJ
V SWT = V CC
C SWT = 0.33μF
Initial mode
Normal mode
Initial mode
Normal mode
92.16
1.44
53.7
0.93
102.4
1.6
82.5
1.43
112.64
1.76
111.9
1.94
s
s
SWT Adjustable Timeout Current
SWT Default Timeout Threshold
SWT Adjustable Timeout
Threshold
I SWT
V SWT-DEF
V SWT-ADJ
SWT = GND
V SWT ≥ V SWT-DEF , selects watchdog default
timeout
(Note 4)
180
1.1
0.95
230
1.25
1.00
280
1.5
1.05
nA
V
V
SWT Adjustable Timeout
Discharge Threshold
SWT Adjustable Timeout Output-
Low Discharge Current
V SWT-DIS
I SWT-DIS
(Note 5)
V SWT = 0.3V
0.7
100
mV
mA
Note 1:
Note 2:
Note 3:
Note 4:
Note 5:
Device may be supplied from IN1–IN4 or V CC .
100% production tested at T A = +25°C and T A = +85°C. Specifications at T A = -40°C are guaranteed by design.
The internal supply voltage, measured at V CC , equals the maximum of IN1–IN4.
External capacitor is charged by I S_T when V S_T-DIS < V S_T < V S_T-ADJ .
External capacitor is discharged by I S_T-DIS down to V S_T-DIS after V S_T reaches V S_T-ADJ .
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3
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