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参数资料
| 型号： | MAX71020AEUI+ |
| 厂商： | Maxim Integrated |
| 文件页数： | 25/35页 |
| 文件大小： | 0K |
| 描述： | IC ENERGY METER 1PH 28TSSOP |
| 标准包装： | 50 |
| 输入阻抗： | 50 千欧 ~ 100 千欧 |
| 测量误差： | 0.5% |
| 电压 - 高输入/输出： | 2V |
| 电压 - 低输入/输出： | 0.8V |
| 电流 - 电源： | 4.3mA |
| 电源电压： | 2.8 V ~ 3.6 V |
| 测量仪表类型： | 单相 |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 28-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 28-TSSOP |
| 包装： | 管件 |
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MAX71020
Single-Chip Electricity Meter AFE
Table 8. Hardware Control Register Map (continued)
NAME
BYTE
ADDRESS
R/W
DEFAULT
VALUE*
DESCRIPTION
Interrupt configuration register: configure the behavior of the INTZ pin.
BIT
0
1
2
3
4
NAME
IE_WPULSE
IE_VPULSE
IE_YPULSE
IE_XPULSE
IE_XDATA
DESCRIPTION
Enables an interrupt to occur on the leading edge of
WPULSE
Enables an interrupt to occur on the leading edge of
VPULSE
Enables an interrupt to occur on the leading edge of
YPULSE
Enables an interrupt to occur on the leading edge of
XPULSE
Enables an interrupt to occur at the conclusion of the
accumulation interval, indicating that fresh data is
available
INT_CFG
0x30F
R/W
0x0000
8000
5
IE_CEBUSY
Enables an interrupt to occur when the CE cycles is
complete
6
7
11:8
14:12
15
31:16
Reserved
IE_VSTAT
INT_POL
Reserved
D_ODINTZ
Reserved
—
Enables an interrupt to occur when the VSYS status
changes
Interrupt polarity for the PULSE edges. The default
polarity is falling edge.
INT_POL[3]=1: Interrupt on rising edge of YPULSE
INT_POL[2]=1: Interrupt on rising edge of XPULSE
INT_POL[1]=1: Interrupt on rising edge of VPULSE
INT_POL[0]=1: Interrupt on rising edge of WPULSE
—
Enable open-drain on the INTZ output. By default, the
pin is configured as a CMOS totem-pole output.
—
* Default values given for standard CE code (2520 sample frequency, gain = 9).
Maxim Integrated
25
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